{"id":100740,"date":"2021-07-12T04:22:42","date_gmt":"2021-07-12T02:22:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc"},"modified":"2021-07-12T04:22:42","modified_gmt":"2021-07-12T02:22:43","slug":"gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/novosti-interneta\/gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc","title":{"rendered":"Der erste Prototyp des offenen Chips Libre-SOC ist produktionsbereit.","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Das Libre-SOC-Projekt, das an einem offenen Chip mit einer hybriden Architektur im Stil der CDC 6600 arbeitet, hat die erste Testversion in die Produktionsphase \u00fcberf\u00fchrt. Um die Gr\u00f6\u00dfe und Komplexit\u00e4t des Chips zu reduzieren, werden die CPU-, VPU- und GPU-Anweisungen nicht getrennt, sondern in einem einzigen ISA angeboten. Urspr\u00fcnglich wurde das Projekt unter dem Namen Libre RISC-V entwickelt, bevor es in Libre-SOC umbenannt wurde, nachdem beschlossen wurde, RISC-V durch die Verwendung der OpenPOWER 3.0-Befehlssatzarchitektur zu ersetzen. <\/p>\n

Das Projekt zielt darauf ab, ein vollst\u00e4ndiges, v\u00f6llig offenes System-on-a-Chip (SoC) zu schaffen, das ohne Lizenzgeb\u00fchren genutzt werden kann und in Einplatinencomputern, Netbooks und verschiedenen tragbaren Ger\u00e4ten eingesetzt wird. Neben den typischen CPU-Befehlen und allgemeinen Registern bietet Libre-SOC in einem einzigen funktionalen Prozessorblock die M\u00f6glichkeit, Vektoroperationen und spezialisierte Berechnungen durchzuf\u00fchren, die normalerweise VPU und GPU vorbehalten sind. Der Chip verwendet die OpenPOWER-Befehlssatzarchitektur, die Simple-V-Erweiterung mit Anweisungen zur Vektorisierung und parallelen Datenverarbeitung sowie spezialisierte Anweisungen zur Umwandlung in ARGB und zur Durchf\u00fchrung typischer 3D-Operationen. <\/p>\n

Die GPU-Anweisungen konzentrieren sich auf die Nutzung der Grafik-API Vulkan, w\u00e4hrend die VPU auf die Beschleunigung der YUV-RGB-Konvertierung und die Dekodierung von MPEG1\/2, MPEG4 ASP (xvid), H.264, H.265, VP8, VP9, AV1, MP3, AC3, Vorbis und Opus abzielen. F\u00fcr Mesa wird ein Open-Source-Treiber entwickelt, der die M\u00f6glichkeiten von Libre-SOC nutzt, um eine hardwarebeschleunigte Softwareimplementierung der Grafik-API Vulkan bereitzustellen. Zum Beispiel k\u00f6nnen Vulkan-Shader mithilfe einer JIT-Engine \u00fcbersetzt werden, um die spezialisierten Anweisungen, die in Libre-SOC verf\u00fcgbar sind, auszuf\u00fchren. <\/p>\n

Im n\u00e4chsten Testprototyp wird geplant, die Erweiterung SVP64 (Variable-length Vectorisation) umzusetzen, die es erm\u00f6glicht, Libre-SOC als Vektorprozessor zu nutzen (neben 32 64-Bit-Allzweckregistern werden 128 Register f\u00fcr Vektorberechnungen zur Verf\u00fcgung gestellt). Der erste Prototyp umfasst nur einen Kern, der mit 300 MHz arbeitet, aber innerhalb von zwei Jahren wird eine 4-Kern-Version erwartet, gefolgt von einer 8-Kern-Version und langfristig einer 64-Kern-Version. <\/p>\n

Die erste Charge des Chips wird bei TSMC mit einem Fertigungsprozess von 180 nm hergestellt. Alle Ergebnisse des Projekts stehen unter freien Lizenzen zur Verf\u00fcgung, einschlie\u00dflich der GDS-II-Dateien, die eine vollst\u00e4ndige Chip-Topologie beschreiben und ausreichend sind, um die eigene Produktion zu starten. Libre-SOC wird der erste vollst\u00e4ndig unabh\u00e4ngige Chip auf Basis der Power-Architektur sein, der nicht von IBM hergestellt wird. Bei der Entwicklung wurde die Hardware-Beschreibungssprache nMigen (HDL basierend auf Python, ohne VHDL und Verilog) verwendet, die FlexLib-Bibliothek f\u00fcr Standardzellen aus dem Projekt Chips4Makers sowie das freie VLSI-Werkzeug Coriolis2 zur Umwandlung von HDL in GDS-II genutzt. <\/p>\n

Die Entwicklung des Libre-SOC wurde von der NLnet Foundation finanziert, die 400.000 Euro bereitgestellt hat, um einen vollst\u00e4ndig offenen Chip im Rahmen eines Programms zur Schaffung von verifizierbaren und vertrauensw\u00fcrdigen grundlegenden technischen L\u00f6sungen zu entwickeln. Der Chip hat die Ma\u00dfe 5,5 x 5,9 mm und umfasst 130.000 Logikgatter. Er enth\u00e4lt vier SRAM-Module mit je 4 KB und einen 300-MHz-Phasenregelkreis (PLL).

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Quelle: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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