{"id":103469,"date":"2022-03-03T15:36:38","date_gmt":"2022-03-03T13:36:39","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/intel-amd-i-arm-predstavili-ucie-otkrytyj-standart-dlya-chipletov"},"modified":"2022-03-03T15:36:38","modified_gmt":"2022-03-03T13:36:39","slug":"intel-amd-i-arm-predstavili-ucie-otkrytyj-standart-dlya-chipletov","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/novosti-interneta\/intel-amd-i-arm-predstavili-ucie-otkrytyj-standart-dlya-chipletov","title":{"rendered":"Intel, AMD und ARM haben UCIe, einen offenen Standard f\u00fcr Chiplets, vorgestellt.","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"
Die Gr\u00fcndung des Konsortiums UCIe (Universal Chiplet Interconnect Express) wurde bekannt gegeben, das sich auf die Entwicklung offener Spezifikationen und den Aufbau eines \u00d6kosystems f\u00fcr Chiplet-Technologien konzentriert. Chiplets erm\u00f6glichen die Erstellung von hybriden integrierten Schaltkreisen (Multi-Chip-Module), die aus unabh\u00e4ngigen Halbleiterbausteinen bestehen, die nicht an einen bestimmten Hersteller gebunden sind und \u00fcber eine standardisierte Hochgeschwindigkeits-Schnittstelle UCIe miteinander interagieren.
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Zur Entwicklung ma\u00dfgeschneiderter L\u00f6sungen, beispielsweise zur Schaffung eines Prozessors mit integriertem Beschleuniger f\u00fcr maschinelles Lernen oder zur Verarbeitung von Netzwerkoperationen, ist es ausreichend, bereits existierende Chiplets mit Prozessorkernen oder Beschleunigern verschiedener Hersteller \u00fcber UCIe zu integrieren. Wenn standardisierte L\u00f6sungen fehlen, kann man einen eigenen Chiplet mit den ben\u00f6tigten Funktionen erstellen, indem man Technologien und L\u00f6sungen nutzt, die einem am besten zusagen. <\/p>\n
Anschlie\u00dfend m\u00fcssen die ausgew\u00e4hlten Chiplets lediglich in einer blockbasierten Anordnung zusammengestellt werden, \u00e4hnlich dem LEGO-Bausatzprinzip. Diese vorgeschlagene Technologie erinnert an die Verwendung von PCIe-Karten, um die Komponenten eines Computers zusammenzuf\u00fcgen, jedoch auf Ebene der integrierten Schaltungen. Der Datenaustausch und die Interaktion zwischen den Chiplets erfolgen \u00fcber die Hochgeschwindigkeits-Schnittstelle UCIe, w\u00e4hrend zur Anordnung der Bl\u00f6cke das Paradigma \"System im Geh\u00e4use\" (SoP, System-on-Package) anstelle von \"System auf Chip\" (SoC, System-on-Chip) verwendet wird. <\/p>\n
Im Vergleich zu SoC-Technologien erm\u00f6glichen Chiplet-Architekturen die Schaffung von austauschbaren und wiederverwendbaren Halbleiterbausteinen, die in verschiedenen Ger\u00e4ten eingesetzt werden k\u00f6nnen, was die Kosten f\u00fcr die Chip-Entwicklung erheblich senkt. In chiplet-basierten Systemen k\u00f6nnen unterschiedliche Architekturen und Produktionsprozesse kombiniert werden \u2013 da jede Chiplet unabh\u00e4ngig funktioniert und \u00fcber standardisierte Schnittstellen interagiert, k\u00f6nnen in einem Produkt Bausteine mit unterschiedlichen Befehlssatzarchitekturen (ISA) wie RISC-V, ARM und x86 zusammengef\u00fchrt werden. Der Einsatz von Chiplets erleichtert auch das Testen \u2013 jedes Chiplet kann unabh\u00e4ngig vor der Integration in die fertige L\u00f6sung getestet werden.
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Die Initiative zur F\u00f6rderung der Chiplet-Technologie wird von Unternehmen wie Intel, AMD, ARM, Qualcomm, Samsung, ASE (Advanced Semiconductor Engineering), Google Cloud, Meta\/Facebook, Microsoft und Taiwan Semiconductor Manufacturing Company unterst\u00fctzt. Der \u00d6ffentlichkeit wurde die offene Spezifikation UCIe 1.0 vorgestellt, die Methoden zur Verbindung von integrierten Schaltungen auf einer gemeinsamen Grundlage, einen Protokollstack, ein Softwaremodell und einen Testprozess standardisiert. F\u00fcr die Verbindung von Chiplets wurde Unterst\u00fctzung f\u00fcr PCIe (PCI Express) und CXL (Compute Express Link) angek\u00fcndigt. \n Quelle: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"
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