{"id":114581,"date":"2024-03-26T12:25:42","date_gmt":"2024-03-26T10:25:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen"},"modified":"2024-03-26T12:25:42","modified_gmt":"2024-03-26T10:25:43","slug":"zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/news\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","title":{"rendered":"ZenHammer \u2014 eine Angriffsform zur Ver\u00e4nderung des Speicherinhalts auf AMD Zen-Plattformen","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Forscher der ETH Z\u00fcrich haben eine Angriffsmethode namens ZenHammer entwickelt, die eine Variation der RowHammer-Angriffe darstellt, um den Inhalt einzelner Bits im dynamischen Arbeitsspeicher (DRAM) zu ver\u00e4ndern, angepasst f\u00fcr die Nutzung auf Plattformen mit AMD-Prozessoren. Fr\u00fchere RowHammer-Angriffsmethoden beschr\u00e4nkten sich auf Systeme mit Intel-Prozessoren, jedoch zeigte die durchgef\u00fchrte Studie, dass auch Verzerrungen in Speichermodulen auf Plattformen mit AMD-Speichercontrollern erzielt werden k\u00f6nnen. <\/p>\n

Die Funktionsweise der Methode wurde auf AMD Zen 2- und Zen 3-Systemen mit DDR4-Speicher von drei f\u00fchrenden Herstellern (Samsung, Micron und SK Hynix) demonstriert. Der Angriff erlaubt es, den in den Speichermodulen implementierten TRR-Mechanismus (Target Row Refresh) zu umgehen, der zum Schutz vor Verzerrungen in benachbarten Zeilen gedacht ist. Laut den Forschern sind Systeme auf Basis des AMD Zen 3-CPUs anf\u00e4lliger als Systeme mit Intel Coffee Lake-Prozessoren und einfacher sowie effektiver anzugreifen. Bei AMD Zen 2-Systemen konnten Verzerrungen in 7 von 10 getesteten DDR4-Chips erreicht werden, bei Zen 3 in 6 von 10. Die Forscher analysierten auch die M\u00f6glichkeit eines Angriffs auf AMD Zen 4-Systeme mit DDR5-Speicher, jedoch konnte die f\u00fcr DDR4 entwickelte Angriffsmethode nur auf 1 von 10 getesteten DDR5-Speichermodulen erfolgreich reproduziert werden, wobei die Angriffsm\u00f6glichkeit nicht ausgeschlossen, jedoch die Entwicklung effektiverer Lesemuster erforderlich ist, die f\u00fcr DDR5-Ger\u00e4te geeignet sind. <\/p>\n

F\u00fcr die Arbeit mit AMD-Chips konnten zuvor entwickelte Exploits angepasst werden, die die Inhalte der Eintr\u00e4ge in der Speichertabelle (PTE, page table entry) \u00e4ndern, um Kernel-Rechte zu erlangen. Diese Exploits umgehen die Passwort- und Berechtigungs\u00fcberpr\u00fcfung durch die Modifikation des Speichers des sudo-Prozesses und besch\u00e4digen den im Speicher abgelegten \u00f6ffentlichen RSA-2048-Schl\u00fcssel von OpenSSH, um den privaten Schl\u00fcssel wiederherzustellen. Der Angriff auf die Speichertabellen konnte bei 7 von 10 getesteten DDR4-Chips reproduziert werden, der Angriff auf den RSA-Schl\u00fcssel bei 6 Chips und der Angriff auf sudo bei 4 Chips, wobei die Angriffszeiten 164, 267 und 209 Sekunden betrugen.

\"ZenHammer<\/center> <\/p>\n

Die Methode kann auch f\u00fcr Angriffe auf Systeme \u00fcber Browser verwendet werden, um \u00c4nderungen vorzunehmen aus virtuelle Maschinen<\/a> oder zur Durchf\u00fchrung eines Angriffs \u00fcber das Netzwerk. Auf GitHub sind unter der MIT-Lizenz die Quellcodes des DARE-Tools f\u00fcr Reverse Engineering der Adressanordnung im DRAM sowie zwei S\u00e4tze von Utilities f\u00fcr Fuzzing-Tests zur Bitverf\u00e4lschung im Speicher verf\u00fcgbar \u2014 ddr4_zen2_zen3_pub f\u00fcr DDR4-Chips (Zen 2 und Zen 3) und ddr5_zen4_pub f\u00fcr DDR5-Chips (Zen 4), die zur \u00dcberpr\u00fcfung der eigenen Systeme auf Anf\u00e4lligkeit gegen\u00fcber Angriffen verwendet werden k\u00f6nnen.

\"ZenHammer<\/center> <\/p>\n

F\u00fcr die Bitverzerrung wird die RowHammer-Methode verwendet, die auf der Tatsache beruht, dass im DRAM-Speicher, der ein zweidimensionales Array von Zellen besteht, die aus einem Kondensator und einem Transistor bestehen, das kontinuierliche Lesen eines bestimmten Speicherbereichs zu Spannungsschwankungen und Anomalien f\u00fchrt, die einen kleinen Verlust der Ladung benachbarter Zellen verursachen. Wenn die Lesetaktung hoch ist, kann die benachbarte Zelle genug Ladung verlieren, sodass der n\u00e4chste Regenerationszyklus nicht in der Lage ist, ihren urspr\u00fcnglichen Zustand wiederherzustellen, was zu einer \u00c4nderung des in der Zelle gespeicherten Wertes f\u00fchrt. Im Verlauf der Forschung wurden Besonderheiten der in AMD-Prozessoren verwendeten Mechanismen zur Zuordnung physischer Speichereinheiten und zur Synchronisation mit der Speicheraktualisierung identifiziert, die es erm\u00f6glichten, eine Low-Level-Adressierung von DRAM zu rekonstruieren, Adressen benachbarter Zellen zu bestimmen, Umgehungsmethoden f\u00fcr das Caching zu entwickeln und Muster sowie Frequenzen von Operationen zu berechnen, die zu Ladungsverlust f\u00fchren. <\/p>\n

Um sich gegen RowHammer zu sch\u00fctzen, verwenden Chip-Hersteller den TRR-Mechanismus (Target Row Refresh), der Verzerrungen in bestimmten F\u00e4llen blockiert, jedoch nicht vor allen m\u00f6glichen Angriffsvarianten sch\u00fctzt. Die effektivste Schutzmethode bleibt der Einsatz von Speicher mit Fehlerkorrekturcodes (ECC), die Angriffe nach dem RowHammer-Prinzip erheblich erschweren, jedoch nicht vollst\u00e4ndig ausschlie\u00dfen. Eine Erh\u00f6hung der Regenerationsfrequenz des Speichers kann ebenfalls die Wahrscheinlichkeit eines erfolgreichen Angriffs verringern. <\/p>\n

Das Unternehmen AMD hat einen Bericht \u00fcber das Problem ver\u00f6ffentlicht, in dem erl\u00e4utert wird, dass in AMD-Prozessoren Speicherkontroller verwendet werden, die den DDR-Spezifikationen entsprechen. Da der Erfolg eines Angriffs haupts\u00e4chlich von den Systemeinstellungen und dem DRAM-Speicher abh\u00e4ngt, sollten bei Fragen zur Behebung des Problems die Speicher- und Systemhersteller kontaktiert werden. Zu den bestehenden Methoden zur Erschwerung von Angriffen der Klasse Rowhammer geh\u00f6rt die Verwendung von ECC-Speicher, die Erh\u00f6hung der Speicherregenerierungsfrequenz, das Deaktivieren des verz\u00f6gerten Regenerierungsmodus und die Verwendung von Prozessoren mit Controllern, die den MAC-Modus (Maximum Activate Count) f\u00fcr DDR4 (1., 2. und 3. Generation AMD EPYC \u201eNaples\u201c, \u201eRome\u201c und \u201eMilan\u201c) und RFM (Refresh Management) f\u00fcr DDR5 (4. Generation AMD EPYC) unterst\u00fctzen.
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Quelle: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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