{"id":53569,"date":"2019-12-05T00:00:00","date_gmt":"2019-12-04T21:00:00","guid":{"rendered":"https:\/\/prohoster.info\/blog\/blog_prohoster\/intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess"},"modified":"2020-02-18T14:01:29","modified_gmt":"2020-02-18T11:01:29","slug":"intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/novosti-interneta\/intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess","title":{"rendered":"Intel Rocket Lake ist der Transfer neuer 10-nm Willow-Cove-Kerne auf den 14-nm Produktionsprozess","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Die Architektur des Willow Cove Prozessorkerns basiert auf Sunny Cove \u2013 dem ersten Intel-Kern mit einem wirklich neuen Design seit f\u00fcnf Jahren. Allerdings wurde Sunny Cove nur in den 10-nm-Prozessoren Ice Lake implementiert, w\u00e4hrend die Willow Cove Kerne in den Tiger Lake CPUs (10-nm+ Fertigungstechnologie) auftauchen sollen. Die Massenproduktion von 10-nm-Chips von Intel wurde auf Ende 2020 verschoben, sodass Intel-Fans m\u00f6glicherweise ein weiteres Jahr mit relativ alter Architektur auskommen m\u00fcssen.<\/p>\n

\"Intel<\/p>\n

Es stellte sich jedoch heraus, dass Intel daran arbeitet, die Willow Cove-Kerne an die aktuellen 14-nm Standards anzupassen, und dies k\u00f6nnte bereits in den Rocket Lake Prozessoren umgesetzt werden. Zumindest berichtete dies ein Twitter-Nutzer mit dem Nicknamen @chiakokhua, ein pensionierter Ingenieur im Bereich VLSI (Fertigung von Very Large Scale Integrationsschaltungen), der auf seinem Account verschiedene Neuigkeiten zur CPU-Architektur schreibt.<\/p>\n

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Hier ist die korrekte \u00dcbersetzung: <\/p>\n

\u201eEntschuldigung, ich habe Fehler beim Kopieren der Spezifikation gemacht. RKL-UP3\/S sollte AVX-512 sein.\u201c <\/p>\n

\u201eEinfach gesagt: RKL = 14 nm-Version von TGL, minus iTBT, mit geschw\u00e4chtem IGD.\u201c <\/p>\n

\u201eZus\u00e4tzlich wurde das VRM-Schema auf SVID ge\u00e4ndert.\u201c pic.twitter.com\/B8pRLOnB7f<\/a><\/noindex><\/p>\n

\u2014 RetiredEngineer\u00ae (@chiakokhua) 2. Dezember 2019<\/a><\/noindex><\/p><\/blockquote>\n

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Er stellte fest, dass in den technischen Unterlagen f\u00fcr Rocket Lake im Wesentlichen beschrieben wird, dass es sich um eine 14-nm Anpassung von Tiger Lake handelt, jedoch f\u00fcr die integrierte Grafik wesentlich weniger Transistorbudget vorgesehen ist: Dies mussten die Ingenieure in Kauf nehmen, um Platz f\u00fcr gr\u00f6\u00dfere Prozessorkerne zu schaffen. Auch der FIVR (Fully Integrated Voltage Regulator) aus Tiger Lake wird in diesem Prozessor durch ein traditionelles SVID VRM Stromversorgungssystem ersetzt.<\/p>\n

<\/center>
\n\"Intel<\/p>\n

Aus fr\u00fcheren Berichten ist bekannt, dass der 14-nm Chip Rocket Lake-S bis zu 8 Prozessorkerne umfasst, w\u00e4hrend sein Vorg\u00e4nger Comet Lake-S bis zu 10 Kerne hatte. Jetzt ist klar, dass die reduzierte Anzahl an Kernen offenbar teilweise durch einen Gewinn in Bezug auf die Anzahl der pro Taktzyklen ausf\u00fchrbaren Instruktionen (IPC) kompensiert wird. Dies k\u00f6nnte die erste signifikante Steigerung des IPC seit den Skylake-Prozessoren sein.<\/p>\n

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<\/center><\/p>\n

\t\t\t\t


\n\t\t\t\t\t\t\t\t<\/center>
Quelle: 3dnews.ru<\/a><\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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\u043f\u043e\u044f\u0432\u0438\u0442\u044c\u0441\u044f \u0432 \u0426\u041f Tiger Lake (\u0442\u0435\u0445\u043f\u0440\u043e\u0446\u0435\u0441\u0441 10 \u043d\u043c+). \u041c\u0430\u0441\u0441\u043e\u0432\u0430\u044f \u043f\u0435\u0447\u0430\u0442\u044c 10-\u043d\u043c \u043a\u0440\u0438\u0441\u0442\u0430\u043b\u043b\u043e\u0432 Intel \u0437\u0430\u0434\u0435\u0440\u0436\u0438\u0432\u0430\u0435\u0442\u0441\u044f \u0434\u043e \u043a\u043e\u043d\u0446\u0430 2020 \u0433\u043e\u0434\u0430, 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