{"id":53569,"date":"2019-12-05T00:00:00","date_gmt":"2019-12-04T21:00:00","guid":{"rendered":"https:\/\/prohoster.info\/blog\/blog_prohoster\/intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess"},"modified":"2020-02-18T14:01:29","modified_gmt":"2020-02-18T11:01:29","slug":"intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/news\/intel-rocket-lake-eto-perenos-novyh-10-nm-yader-willow-cove-na-14-nm-tehprotsess","title":{"rendered":"Intel Rocket Lake ist der Transfer neuer 10-nm Willow Cove Kerne auf den 14-nm Fertigungsprozess.","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Die Entwicklung des Willow Cove-Prozessorkerns basiert auf Sunny Cove \u2013 dem ersten Intel-Kern mit einem wirklich neuen Design seit den letzten 5 Jahren. Sunny Cove wird jedoch nur in den 10-nm-Prozessoren Ice Lake realisiert, w\u00e4hrend die Willow Cove-Kerne in den Tiger Lake-CPUs (10 nm+ Fertigungstechnik) erscheinen sollen. Die Massenproduktion der 10-nm-Chips von Intel verz\u00f6gert sich bis Ende 2020, sodass Intel-Enthusiasten noch ein weiteres Jahr mit einer relativ alten Architektur leben m\u00fcssen.<\/p>\n

\"Intel<\/p>\n

Es stellt sich jedoch heraus, dass Intel daran arbeitet, die Willow Cove-Kerne an seine modernen 14-nm-Vorgaben anzupassen, und dies k\u00f6nnte bereits in den Prozessoren Rocket Lake umgesetzt werden. Mindestens das hat ein Twitter-Nutzer namens @chiakokhua, ein pensionierter Ingenieur im Bereich VLSI (Die Herstellung von Very Large Scale Integrationsschaltungen), in seinem Account berichtet, wo er verschiedene Neuigkeiten zur CPU-Architektur teilt.<\/p>\n

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Hier ist die richtige \u00dcbersetzung: <\/p>\n

\u201eEntschuldigung, ich habe beim Kopieren der Spezifikationen Fehler gemacht. RKL-UP3\/S sollte AVX-512 sein.\u201c <\/p>\n

\u201eIn einfachen Worten: RKL = 14nm-Version von TGL, ohne iTBT, mit geschw\u00e4chtem IGD\u201c <\/p>\n

\u201eZus\u00e4tzlich wurde das VRM-Schema auf SVID ge\u00e4ndert.\u201c pic.twitter.com\/B8pRLOnB7f<\/a><\/noindex><\/p>\n

\u2014 RetiredEngineer\u00ae (@chiakokhua) 2. Dezember 2019<\/a><\/noindex><\/p><\/blockquote>\n

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Er merkte an, dass in den technischen Dokumenten von Rocket Lake das Design im Grunde als 14-nm-Adaption von Tiger Lake beschrieben wird, jedoch der integrierten Grafik erheblich weniger Transistorbudget zugewiesen wurde: Dies mussten die Ingenieure tun, um Platz f\u00fcr umfangreichere Prozessorkerne zu schaffen. Au\u00dferdem wird der FIVR (Fully Integrated Voltage Regulator) aus Tiger Lake in diesem Prozessor durch ein traditionelles SVID VRM-Stromversorgungssystem ersetzt.<\/p>\n

<\/center>
\n\"Intel<\/p>\n

Aus fr\u00fcheren Berichten ist bekannt, dass der 14-nm-Chip Rocket Lake-S bis zu 8 Prozessorkerne umfassen wird, obwohl sein Vorg\u00e4nger, Comet Lake-S, bis zu 10 Kerne hatte. Jetzt ist klar, dass die reduzierte Anzahl an Kernen anscheinend teilweise durch Gewinne in Bezug auf die Anzahl der pro Takt ausgef\u00fchrten Instruktionen (IPC) kompensiert wird. Dies k\u00f6nnte das erste bedeutende IPC-Upgrade seit der Skylake-Prozessoren sein.<\/p>\n

<\/p>\n

<\/center><\/p>\n

\t\t\t\t


\n\t\t\t\t\t\t\t\t<\/center>
Quelle: 3dnews.ru<\/a><\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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\u043f\u043e\u044f\u0432\u0438\u0442\u044c\u0441\u044f \u0432 \u0426\u041f Tiger Lake (\u0442\u0435\u0445\u043f\u0440\u043e\u0446\u0435\u0441\u0441 10 \u043d\u043c+). \u041c\u0430\u0441\u0441\u043e\u0432\u0430\u044f \u043f\u0435\u0447\u0430\u0442\u044c 10-\u043d\u043c \u043a\u0440\u0438\u0441\u0442\u0430\u043b\u043b\u043e\u0432 Intel \u0437\u0430\u0434\u0435\u0440\u0436\u0438\u0432\u0430\u0435\u0442\u0441\u044f \u0434\u043e \u043a\u043e\u043d\u0446\u0430 2020 \u0433\u043e\u0434\u0430, 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