{"id":77492,"date":"2020-04-10T19:42:45","date_gmt":"2020-04-10T17:42:45","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe"},"modified":"2020-04-10T19:42:45","modified_gmt":"2020-04-10T17:42:45","slug":"poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","status":"publish","type":"post","link":"https:\/\/prohoster.info\/de\/blog\/news\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","title":{"rendered":"Vorsicht, ARM? Die neuen 64-Bit-Kerne von Synopsys ARC erh\u00f6hen die Leistung um das Dreifache.","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"<p>Wenige wissen, dass die Prozessorarchitektur ARC eine der am weitesten verbreiteten Architekturen ist, neben ARM, MIPS und x86. In den 1980er Jahren entwickelt, findet die ARC-Architektur Anwendung in verschiedenen Mikrocontrollern f\u00fcr eine Vielzahl von High-Tech-Produkten, und jedes Jahr werden auf Basis von ARC etwa <noindex><a rel=\"nofollow\" href=\"https:\/\/www.techdesignforums.com\/practice\/technique\/power-performance-processor-ip\/\">1,5 Milliarden<\/a><\/noindex> Ger\u00e4te produziert.<\/p>\n<p>K\u00fcrzlich hat die Firma Synopsys eine neue Generation von 32- und 64-Bit-ARC-Prozessor-Kernen angek\u00fcndigt, die versprechen, die Leistung im Vergleich zu ihren Vorg\u00e4ngern zu verdreifachen und es erm\u00f6glichen, Systeme-on-a-Chip mit 12 Kernen zu entwickeln. Somit werden die neuen Kerne Synopsys in die Lage versetzen, im Bereich ARM in mehreren neuen Richtungen zu konkurrieren.<\/p>\n<p>\u201eEingebettete Anwendungen wie Controller f\u00fcr Solid-State-Laufwerke oder Netzwerkausr\u00fcstungen werden immer komplexer, was eine erhebliche Steigerung der Leistung bei begrenztem Energieverbrauch und Platz erfordert\u201c, sagte John Koeter, Senior Vice President f\u00fcr Marketing und Strategie im Bereich geistiges Eigentum bei Synopsys. \u201eMit der Einf\u00fchrung der neuen Architektur ARCv3 und der ARC-Kerne HS5x und HS6x k\u00f6nnen Entwickler den wachsenden Leistungsanforderungen ihrer SoCs heute und in Zukunft gerecht werden.\u201c<\/p>\n<p><img decoding=\"async\" alt=\"Vorsicht, ARM? Die neuen 64-Bit-Kerne von Synopsys ARC erh\u00f6hen die Leistung um das Dreifache.\" src=\"\/wp-content\/uploads\/2020\/04\/2ae4489c52d3424c0317469dc432a708.png\" style=\"display:block;margin: 0 auto;\" \/><br \/>\n<\/center><\/p>\n<p>Die neuen Prozessorfamilien von Synopsys DesignWare ARC umfassen 32-Bit-Kerne <noindex><a rel=\"nofollow\" href=\"https:\/\/c212.net\/c\/link\/?t=0&amp;l=en&amp;o=2770609-1&amp;h=1317167553&amp;u=https%3A%2F%2Fwww.synopsys.com%2Fdw%2Fipdir.php%3Fds%3Darc-HS5x-processors&amp;a=HS5x\">HS56\/HS57D\/HS58<\/a><\/noindex> und 64-Bit-Kerne <noindex><a rel=\"nofollow\" href=\"https:\/\/www.synopsys.com\/dw\/ipdir.php?ds=arc-HS6x-processors\">HS66\/HS68<\/a><\/noindex>. Die neu angek\u00fcndigten Prozessoren sind f\u00fcr eine Vielzahl von Anwendungen bestimmt, darunter Controller f\u00fcr Solid-State-Laufwerke (SSD), Netzwerkcontroller, Autopiloten f\u00fcr Fahrzeuge, Infotainmentsysteme und viele weitere. Angesichts der wachsenden Anforderungen an den Arbeitsspeicher erm\u00f6glichen die 64-Bit ARC HD6x die Erstellung von Systemen mit 4,5 PB DRAM, w\u00e4hrend Ger\u00e4te auf Basis der ARC HD5x sich mit kleineren Kapazit\u00e4ten begn\u00fcgen m\u00fcssen. Die tats\u00e4chlich unterst\u00fctzte Arbeitsspeichermenge wird jedoch eher durch das verwendete Betriebssystem festgelegt, w\u00e4hrend die sichtbaren Vorteile der 64-Bit-CPUs ein breiteres Pipeline-Design und eine gr\u00f6\u00dfere Registerdatei umfassen.<\/p>\n<p>Die DesignWare ARC HS5x und DesignWare ARC HS6x Architekturen unterst\u00fctzen den Befehlssatz ARCv3, der durch APEX-Instruktionen (ARC Processor EXtensions) erweitert werden kann, falls Kunden spezifische Anforderungen haben. Zudem ist der ARC HS57D mit einem digitalen Signalprozessor ARCv3DSP ausgestattet, der 150 Befehle unterst\u00fctzt. Die neuen Kerne verf\u00fcgen \u00fcber eine Pipeline-Tiefe von 10 Stufen, k\u00f6nnen zwei Befehle pro Taktzyklus ausf\u00fchren und sind mit einem 128-Bit-Floating-Point-Modul ausgestattet. Die fortschrittlichsten Versionen der Kerne unterst\u00fctzen dar\u00fcber hinaus einen sekund\u00e4ren Cache (L2) von bis zu 16 MB.<\/p>\n<p><img decoding=\"async\" alt=\"Vorsicht, ARM? Die neuen 64-Bit-Kerne von Synopsys ARC erh\u00f6hen die Leistung um das Dreifache.\" src=\"\/wp-content\/uploads\/2020\/04\/044e34c8c0bede9efcdfc730a3ce3ec3.png\" style=\"display:block;margin: 0 auto;\" \/><\/p>\n<p>Was die Leistung angeht, so gibt Synopsys 3 DMIPS pro MHz bei Ganzzahlberechnungen an sowie 5,1 CoreMark pro MHz, was f\u00fcr minimal energieeffiziente Kerne sehr gut ist. So liegen 3 DMIPS pro MHz \u00fcber dem, was bei recht leistungsstarken Prozessoren zu beobachten ist. <noindex><a rel=\"nofollow\" href=\"https:\/\/en.wikipedia.org\/wiki\/Comparison_of_ARMv8-A_cores\">Cortex-A55<\/a><\/noindex>, w\u00e4hrend 5,1 CoreMark pro MHz \u00fcber dem Wert liegt, den man bei jedem anderen Prozessor findet. <noindex><a rel=\"nofollow\" href=\"https:\/\/en.wikichip.org\/wiki\/coremark-mhz\">ARM-Prozessor f\u00fcr Mikrocontroller.<\/a><\/noindex><\/p>\n<table class=\"neat\" style=\"width: 800px;\">\n<tbody>\n<tr>\n<td class=\"dark\" colspan=\"6\" valign=\"top\">\n<p align=\"center\" style=\"text-align: center;\"><strong>Die Prozessorkerne Synopsys DesignWare ARC HS5x und HS6x<br \/><\/strong><\/p>\n<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\"><\/td>\n<td class=\"light\" colspan=\"3\" style=\"text-align: center;\" valign=\"top\">HS5x<\/td>\n<td class=\"light\" colspan=\"2\" style=\"text-align: center;\" valign=\"top\">HS6x<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\"><\/td>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\">HS56<\/td>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\">HS57D<\/td>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\">HS58<\/td>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\">HS66<\/td>\n<td class=\"light\" style=\"text-align: center;\" valign=\"top\">HS68<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Der Befehlssatz<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">ARCv3<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">APEX-Instruktionen<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">Unterst\u00fctzt<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Bit-Tiefe<\/td>\n<td colspan=\"3\" style=\"text-align: center;\" valign=\"top\">32-Bit<\/td>\n<td colspan=\"2\" style=\"text-align: center;\" valign=\"top\">64-Bit<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Befehle pro Takt<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">2<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Pipeline-L\u00e4nge<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">10 Stufen<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">DSP<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">ARCv3DSP <br \/>150 Befehle<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">FPU-Genauigkeit<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">FP16, FP32, FP64<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Prozessorcluster<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">12 Kerne<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Beschleuniger im Cluster<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">16 Beschleuniger<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">L1<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">Befehlscache + Datencache<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">L2<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">16 Megabyte<\/td>\n<td style=\"text-align: center;\" valign=\"top\">&#8212;<\/td>\n<td style=\"text-align: center;\" valign=\"top\">16 Megabyte<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Maximaler Speicher<\/td>\n<td colspan=\"3\" style=\"text-align: center;\" valign=\"top\">64 Gigabyte (abh\u00e4ngig vom Betriebssystem)<\/td>\n<td colspan=\"2\" style=\"text-align: center;\" valign=\"top\">4,5 Petabyte<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Taktfrequenz (auf SoC 16FFC)<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">1,8 GHz<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">DMIPS<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">5400 DMIPS pro Kern \/ 3 DMIPS pro MHz<\/td>\n<\/tr>\n<tr>\n<td class=\"light\" valign=\"top\">Eine der zentralen Eigenschaften der neuen DesignWare ARC HS5x und DesignWare ARC HS6x Serien ist die F\u00e4higkeit, System-on-Chip-L\u00f6sungen (SoC) mit 12 allgemeinen Prozessorkernen und 16 spezialisierten Beschleunigern zu erstellen. Jeder Kern\/Beschleuniger in solch einem Prozessor arbeitet mit einer eigenen Taktfrequenz und verwendet ein eigenes Stromversorgungssystem, um die Energieeffizienz zu maximieren. Neben den neuen Kernen bietet Synopsys auch eine interne Cache-koh\u00e4rente Verbindung mit einer Daten\u00fcbertragungsrate von 800 GB\/s an.<\/td>\n<td colspan=\"5\" style=\"text-align: center;\" valign=\"top\">9180 CoreMark pro Kern \/ 5,1 CoreMark pro MHz<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n<p>Eine der Hauptmerkmale der neuen DesignWare ARC HS5x und DesignWare ARC HS6x-Familie ist die M\u00f6glichkeit, System-on-Chip (SoC)-L\u00f6sungen mit 12 allgemeinen Prozessorkernen und 16 spezialisierten Beschleunigern zu erstellen. Jeder Kern\/Beschleuniger in einem solchen Prozessor arbeitet mit eigener Taktfrequenz und nutzt ein eigenes Energieversorgungssystem, um die Energieeffizienz zu maximieren. Neben den neuen Kernen bietet Synopsys auch ein innerhalb des Prozessors koh\u00e4rentes Cache-Verbindung mit einer Datenrate von 800 GB\/s an. <\/p>\n<p>SoCs auf Grundlage der ARC-Architektur sind heute nicht weit verbreitet, doch angesichts der zuk\u00fcnftigen Prozessoren f\u00fcr autonome Systeme, Datenspeicherung, Datenflussmanagement, Multicore-F\u00e4higkeit und verschiedene Arten von Beschleunigern sind sie \u00e4u\u00dferst relevant. Letzteres erm\u00f6glicht es Synopsys, mit ARM-Kernen um einen Platz in SoCs f\u00fcr die genannten Anwendungen zu konkurrieren, was bisher nicht der Fall war. So sind die DesignWare ARC HS5x und DesignWare ARC HS6x bereits f\u00fcr den SSD-Hersteller Starblaze von Interesse. <\/p>\n<p>\u201eEntwickler hochleistungsf\u00e4higer eingebetteter L\u00f6sungen stehen st\u00e4ndig vor neuen Herausforderungen, um hohe Leistung bei der Nutzung gro\u00dfer Speichermengen sowie Einschr\u00e4nkungen bei Energieverbrauch und Gr\u00f6\u00dfe zu erreichen\u201c, sagte Bruce Cheng, Chief Scientist bei Starblaze. \u201eDie M\u00f6glichkeiten der neuen 32-Bit-Prozessoren ARC HS5x und 64-Bit-Prozessoren HS6x von Synopsys im Bereich der Mehrkernverarbeitung erm\u00f6glichen es uns, ein neues Niveau der Energieeffizienz zu erreichen, das von anderen derzeit auf dem Markt verf\u00fcgbaren Prozessoren nicht angeboten wird.\u201d<\/p>\n<p><img decoding=\"async\" alt=\"Vorsicht, ARM? Die neuen 64-Bit-Kerne von Synopsys ARC erh\u00f6hen die Leistung um das Dreifache.\" src=\"\/wp-content\/uploads\/2020\/04\/6d6666f6ecba4c244cf699edb28ac981.png\" style=\"display:block;margin: 0 auto;\" \/><\/p>\n<p>Synopsys wird ab dem dritten Quartal 2020 die ARC-Kerne HS56, HS57D, HS58, HS66, HS68 sowie deren Multiprozessorversionen HS56MP, HS57DMP, HS58MP, HS66MP, HS68MP anbieten. Dar\u00fcber hinaus wird das Unternehmen das Paket ARC MetaWare Development Toolkit zur Erstellung von Chips auf Basis dieser Kerne sowie einen Simulator und einen Verifikator zur \u00dcberpr\u00fcfung der Funktionalit\u00e4t von SoC vor der Implementierung in Silizium bereitstellen. Was die Unterst\u00fctzung durch Betriebssysteme betrifft, so sind die neuen Kerne mit einer Reihe von Linux-Distributionen, Zephyr und verschiedenen propriet\u00e4ren Betriebssystemen kompatibel.<\/p>\n<p><center><\/p>\n<p><\/center><\/p>\n<p>\t\t\t\t<center><br \/>\n\t\t\t\t\t\t\t\t<\/center><br \/>Quelle: <a content=\"nofollow\" rel=\"nofollow\" href=\"https:\/\/3dnews.ru\/1007918\">3dnews.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"<p>\u041d\u0435\u043c\u043d\u043e\u0433\u0438\u0435 \u0437\u043d\u0430\u044e\u0442, \u0447\u0442\u043e \u043f\u0440\u043e\u0446\u0435\u0441\u0441\u043e\u0440\u043d\u0430\u044f \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440\u0430 ARC \u044f\u0432\u043b\u044f\u0435\u0442\u0441\u044f \u043e\u0434\u043d\u043e\u0439 \u0438\u0437 \u0441\u0430\u043c\u044b\u0445 \u0440\u0430\u0441\u043f\u0440\u043e\u0441\u0442\u0440\u0430\u043d\u0435\u043d\u043d\u044b\u0445 \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440 \u043d\u0430\u0440\u044f\u0434\u0443 \u0441 ARM, MIPS \u0438 x86. \u0420\u0430\u0437\u0440\u0430\u0431\u043e\u0442\u0430\u043d\u043d\u0430\u044f \u0432 1980-\u0445 \u0433\u043e\u0434\u0430\u0445, \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440\u0430 ARC \u043f\u0440\u0438\u043c\u0435\u043d\u044f\u0435\u0442\u0441\u044f \u0432 \u0440\u0430\u0437\u043b\u0438\u0447\u043d\u044b\u0445 \u043c\u0438\u043a\u0440\u043e\u043a\u043e\u043d\u0442\u0440\u043e\u043b\u043b\u0435\u0440\u0430\u0445 \u0434\u043b\u044f \u0448\u0438\u0440\u043e\u0447\u0430\u0439\u0448\u0435\u0433\u043e \u0441\u043f\u0435\u043a\u0442\u0440\u0430 \u0432\u044b\u0441\u043e\u043a\u043e\u0442\u0435\u0445\u043d\u043e\u043b\u043e\u0433\u0438\u0447\u043d\u043e\u0439 \u043f\u0440\u043e\u0434\u0443\u043a\u0446\u0438\u0438, \u0430 \u043a\u0430\u0436\u0434\u044b\u0439 \u0433\u043e\u0434 \u043d\u0430 \u043e\u0441\u043d\u043e\u0432\u0435 ARC \u043f\u0440\u043e\u0438\u0437\u0432\u043e\u0434\u0438\u0442\u0441\u044f \u043e\u043a\u043e\u043b\u043e 1,5 \u043c\u0438\u043b\u043b\u0438\u0430\u0440\u0434\u0430 \u0443\u0441\u0442\u0440\u043e\u0439\u0441\u0442\u0432. \u041d\u0430 \u0434\u043d\u044f\u0445 \u043a\u043e\u0440\u043f\u043e\u0440\u0430\u0446\u0438\u044f Synopsys \u0430\u043d\u043e\u043d\u0441\u0438\u0440\u043e\u0432\u0430\u043b\u0430 \u043d\u043e\u0432\u043e\u0435 \u043f\u043e\u043a\u043e\u043b\u0435\u043d\u0438\u0435 32- \u0438 64-\u0440\u0430\u0437\u0440\u044f\u0434\u043d\u044b\u0445 \u043f\u0440\u043e\u0446\u0435\u0441\u0441\u043e\u0440\u043d\u044b\u0445 [&hellip;]<\/p>\n","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"author":1,"featured_media":77493,"comment_status":"open","ping_status":"open","sticky":false,"template":"","format":"standard","meta":{"footnotes":""},"categories":[702],"tags":[],"class_list":["post-77492","post","type-post","status-publish","format-standard","has-post-thumbnail","hentry","category-news"],"aioseo_notices":[],"aioseo_head":"\n\t\t<!-- All in One SEO 5.0.0.1 - aioseo.com -->\n\t<meta name=\"description\" content=\"\u041d\u0435\u043c\u043d\u043e\u0433\u0438\u0435 \u0437\u043d\u0430\u044e\u0442, \u0447\u0442\u043e \u043f\u0440\u043e\u0446\u0435\u0441\u0441\u043e\u0440\u043d\u0430\u044f \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440\u0430 ARC \u044f\u0432\u043b\u044f\u0435\u0442\u0441\u044f \u043e\u0434\u043d\u043e\u0439 \u0438\u0437 \u0441\u0430\u043c\u044b\u0445 \u0440\u0430\u0441\u043f\u0440\u043e\u0441\u0442\u0440\u0430\u043d\u0435\u043d\u043d\u044b\u0445 \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440 \u043d\u0430\u0440\u044f\u0434\u0443 \u0441 ARM, MIPS \u0438 x86.\" \/>\n\t<meta name=\"robots\" content=\"max-image-preview:large\" \/>\n\t<meta name=\"author\" content=\"Yuri Gagarin\"\/>\n\t<link rel=\"canonical\" href=\"https:\/\/prohoster.info\/de\/blog\/news\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe\" \/>\n\t<meta name=\"generator\" content=\"All in One SEO (AIOSEO) 5.0.0.1\" \/>\n\t\t<meta property=\"og:locale\" content=\"de_DE\" \/>\n\t\t<meta property=\"og:site_name\" content=\"ProHoster | \u041a\u0443\u043f\u0438\u0442\u044c \u043d\u0430\u0434\u0435\u0436\u043d\u044b\u0439 \u0445\u043e\u0441\u0442\u0438\u043d\u0433 \u0434\u043b\u044f \u0441\u0430\u0439\u0442\u043e\u0432 \u0441 \u0437\u0430\u0449\u0438\u0442\u043e\u0439 \u043e\u0442 DDoS, VPS VDS \u0441\u0435\u0440\u0432\u0435\u0440\u044b\" \/>\n\t\t<meta property=\"og:type\" content=\"article\" \/>\n\t\t<meta property=\"og:title\" content=\"\ud83e\udd47\u041f\u043e\u0431\u0435\u0440\u0435\u0433\u0438\u0441\u044c, ARM? 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