{"id":100740,"date":"2021-07-12T04:22:42","date_gmt":"2021-07-12T02:22:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc"},"modified":"2021-07-12T04:22:42","modified_gmt":"2021-07-12T02:22:43","slug":"gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc","status":"publish","type":"post","link":"https:\/\/prohoster.info\/es\/blog\/news\/gotov-k-proizvodstvu-pervyj-prototip-otkrytogo-chipa-libre-soc","title":{"rendered":"Listo para producci\u00f3n, el primer prototipo del chip abierto Libre-SOC","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

El proyecto Libre-SOC est\u00e1 desarrollando un chip abierto con una arquitectura h\u00edbrida en el estilo del CDC 6600, donde las instrucciones de la CPU, VPU y GPU no est\u00e1n separadas para reducir el tama\u00f1o y la complejidad del chip, y se presentan en una \u00fanica ISA. Ha alcanzado la fase de transferencia a producci\u00f3n del primer prototipo de prueba. Inicialmente, el proyecto se desarroll\u00f3 bajo el nombre de Libre RISC-V, pero fue renombrado a Libre-SOC despu\u00e9s de decidir reemplazar RISC-V por el uso de la arquitectura de conjunto de instrucciones (ISA) OpenPOWER 3.0. <\/p>\n

El proyecto tiene como objetivo crear un sistema en chip (SoC) completamente abierto y sin regal\u00edas que se pueda utilizar en computadoras de una sola placa, netbooks y diversos dispositivos port\u00e1tiles. Adem\u00e1s de las instrucciones y registros de prop\u00f3sito general propios de la CPU, Libre-SOC ofrece, en un \u00fanico bloque funcional del procesador, capacidades para realizar operaciones vectoriales y c\u00e1lculos especializados propios de la VPU y GPU. El chip utiliza la arquitectura de conjunto de instrucciones OpenPOWER, la extensi\u00f3n Simple-V con instrucciones para la vectorizaci\u00f3n y el procesamiento paralelo de datos, as\u00ed como instrucciones especializadas para la conversi\u00f3n a ARGB y la ejecuci\u00f3n de operaciones 3D t\u00edpicas. <\/p>\n

Las instrucciones de la GPU se centran en su uso con la API gr\u00e1fica Vulkan, y la VPU en acelerar la conversi\u00f3n YUV-RGB y la decodificaci\u00f3n de formatos MPEG1\/2, MPEG4 ASP (xvid), H.264, H.265, VP8, VP9, AV1, MP3, AC3, Vorbis y Opus. Se est\u00e1 desarrollando un controlador libre para Mesa que utiliza las capacidades de Libre-SOC para proporcionar una implementaci\u00f3n de software acelerada por hardware de la API gr\u00e1fica Vulkan. Por ejemplo, los sombreados de Vulkan pueden ser traducidos utilizando un motor JIT para ejecutarse utilizando las instrucciones especializadas disponibles en Libre-SOC. <\/p>\n

En el pr\u00f3ximo prototipo de prueba se planea implementar la extensi\u00f3n SVP64 (Vectorizaci\u00f3n de longitud variable), que permitir\u00e1 utilizar Libre-SOC como un procesador vectorial (adem\u00e1s de 32 registros de prop\u00f3sito general de 64 bits, se proporcionar\u00e1n 128 registros para c\u00e1lculos vectoriales). El primer prototipo incluye solo un n\u00facleo que funciona a una frecuencia de 300 Mhz, pero en dos a\u00f1os se planea lanzar una versi\u00f3n de 4 n\u00facleos, luego una de 8 n\u00facleos, y a largo plazo, una de 64 n\u00facleos. <\/p>\n

El primer lote del chip ser\u00e1 producido por la empresa TSMC utilizando el proceso tecnol\u00f3gico de 180nm. Todos los desarrollos del proyecto est\u00e1n bajo licencias libres, incluyendo archivos en formato GDS-II que describen la topolog\u00eda completa del chip, suficiente para iniciar la propia producci\u00f3n. Libre-SOC ser\u00e1 el primer chip completamente independiente basado en la arquitectura Power, fabricado fuera de IBM. Para su desarrollo se utiliz\u00f3 el lenguaje de descripci\u00f3n de hardware nMigen (HDL basado en Python, sin usar VHDL y Verilog), la biblioteca de celdas est\u00e1ndar FlexLib del proyecto Chips4Makers y la suite de herramientas VLSI libre Coriolis2 para la conversi\u00f3n de HDL a GDS-II. <\/p>\n

El desarrollo de Libre-SOC fue financiado por la fundaci\u00f3n NLnet Foundation, que asign\u00f3 400 mil euros para la creaci\u00f3n de un chip completamente abierto en el marco de un programa para desarrollar soluciones t\u00e9cnicas fundamentales que sean verificables y de confianza. El chip tiene un tama\u00f1o de 5.5 \u00d7 5.9 mm e incluye 130 mil puertas l\u00f3gicas. Est\u00e1 compuesto por cuatro m\u00f3dulos de SRAM de 4KB y un bloque de fase de ajuste autom\u00e1tico de frecuencia (PLL) de 300 MHz.

\"Listo<\/center>
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Fuente: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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