{"id":114581,"date":"2024-03-26T12:25:42","date_gmt":"2024-03-26T10:25:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen"},"modified":"2024-03-26T12:25:42","modified_gmt":"2024-03-26T10:25:43","slug":"zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","status":"publish","type":"post","link":"https:\/\/prohoster.info\/es\/blog\/news\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","title":{"rendered":"ZenHammer \u2014 un m\u00e9todo de ataque para distorsionar el contenido de la memoria en plataformas AMD Zen","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Investigadores de la Escuela Polit\u00e9cnica Federal de Z\u00farich han desarrollado el m\u00e9todo de ataque ZenHammer, que es una variante de los ataques de la clase RowHammer para modificar el contenido de bits individuales en la memoria din\u00e1mica (DRAM), adaptado para su uso en plataformas con procesadores AMD. Los m\u00e9todos de ataque anteriores de la clase RowHammer estaban limitados a sistemas basados en procesadores Intel, pero la investigaci\u00f3n realizada ha mostrado que tambi\u00e9n se pueden lograr distorsiones en las celdas de memoria en plataformas con controladores de memoria de AMD. <\/p>\n

El funcionamiento del m\u00e9todo se ha demostrado en sistemas AMD Zen 2 y Zen 3 con memoria DDR4 de tres de los principales fabricantes (Samsung, Micron y SK Hynix). El ataque permite sortear el mecanismo TRR (Target Row Refresh) implementado en los chips de memoria, dise\u00f1ado para proteger contra la distorsi\u00f3n de celdas de memoria en filas adyacentes. Seg\u00fan los investigadores, los sistemas basados en CPU AMD Zen 3 son m\u00e1s vulnerables que los sistemas con procesadores Intel Coffee Lake, y son m\u00e1s f\u00e1ciles y eficientes de atacar. En los sistemas AMD Zen 2, se lograron distorsiones en las celdas en 7 de los 10 chips DDR4 probados, mientras que en los sistemas Zen 3 se logr\u00f3 en 6 de 10. Los investigadores tambi\u00e9n analizaron la posibilidad de llevar a cabo un ataque en sistemas AMD Zen 4 con memoria DDR5, pero el m\u00e9todo de ataque desarrollado para DDR4 solo se pudo reproducir con \u00e9xito en 1 de los 10 chips de memoria DDR5 probados; sin embargo, no se descarta la posibilidad de ataque, pero requiere el desarrollo de patrones de lectura m\u00e1s efectivos adecuados para dispositivos DDR5. <\/p>\n

Para trabajar con los chips AMD, se lograron adaptar exploits previamente desarrollados que modifican el contenido de las entradas de la tabla de p\u00e1ginas de memoria (PTE, page table entry) para obtener privilegios de kernel, eludiendo la verificaci\u00f3n de contrase\u00f1a\/autorizaciones a trav\u00e9s de la modificaci\u00f3n de la memoria del proceso sudo y corrompiendo la clave p\u00fablica RSA-2048 almacenada en memoria en OpenSSH para recrear la clave privada. El ataque a las p\u00e1ginas de memoria se logr\u00f3 reproducir en 7 de los 10 chips DDR4 probados, el ataque a la clave RSA en 6 chips y el ataque a sudo en 4 chips, con un tiempo de ataque de 164, 267 y 209 segundos, respectivamente.

\"ZenHammer<\/center> <\/p>\n

El m\u00e9todo tambi\u00e9n podr\u00eda aplicarse para atacar sistemas a trav\u00e9s de navegadores, para realizar cambios desde m\u00e1quinas virtuales<\/a> o para organizar un ataque a trav\u00e9s de la red. En GitHub, bajo la licencia MIT, se ha publicado el c\u00f3digo fuente de la herramienta DARE para la ingenier\u00eda inversa de la disposici\u00f3n de direcciones en la memoria DRAM, as\u00ed como dos conjuntos de utilidades para pruebas de fuzzing de distorsi\u00f3n de bits en memoria: ddr4_zen2_zen3_pub para chips DDR4 (Zen 2 y Zen 3) y ddr5_zen4_pub para chips DDR5 (Zen 4), que pueden ser utilizados para verificar si sus sistemas son susceptibles a ataques.

\"ZenHammer<\/center> <\/p>\n

Para distorsionar los bits se utiliza el m\u00e9todo RowHammer, que se basa en que en la memoria DRAM, que representa un arreglo bidimensional de celdas compuestas por un condensador y un transistor, la lectura continua de la misma \u00e1rea de memoria provoca fluctuaciones de voltaje y anomal\u00edas que causan una peque\u00f1a p\u00e9rdida de carga en las celdas adyacentes. Si la intensidad de lectura es alta, la celda adyacente puede perder una cantidad suficiente de carga y el ciclo de regeneraci\u00f3n siguiente no puede restaurar su estado original, lo que resulta en un cambio en el valor de los datos almacenados en la celda. La investigaci\u00f3n ha identificado las caracter\u00edsticas de los mecanismos de mapeo de la memoria f\u00edsica y sincronizaci\u00f3n con la actualizaci\u00f3n de la memoria utilizados en los procesadores AMD, lo que ha permitido recrear la direccionamiento de bajo nivel de la DRAM, determinar las direcciones de las celdas adyacentes, desarrollar m\u00e9todos para evadir la cach\u00e9 y calcular patrones y frecuencias de operaciones que conducen a la p\u00e9rdida de carga. <\/p>\n

Para protegerse contra RowHammer, los fabricantes de chips aplican el mecanismo TRR (Target Row Refresh), que bloquea la distorsi\u00f3n de las celdas en casos espec\u00edficos, pero no protege contra todas las posibles variantes de ataque. El m\u00e9todo de protecci\u00f3n m\u00e1s efectivo sigue siendo el uso de memoria con c\u00f3digos de correcci\u00f3n de errores (ECC), que complican significativamente, pero no excluyen por completo la realizaci\u00f3n de ataques del tipo RowHammer. Aumentar la frecuencia de regeneraci\u00f3n de la memoria tambi\u00e9n reduce la probabilidad de un ataque exitoso. <\/p>\n

La empresa AMD ha publicado un informe sobre el problema, indicando que los procesadores AMD utilizan controladores de memoria que cumplen con las especificaciones DDR, y dado que el \u00e9xito del ataque depende principalmente de la configuraci\u00f3n del sistema y la memoria DRAM, las consultas sobre la soluci\u00f3n del problema deben dirigirse a los fabricantes de memoria y sistemas. Entre las formas existentes de dificultar la realizaci\u00f3n de ataques del tipo Rowhammer, se menciona el uso de memoria ECC, el aumento de la frecuencia de regeneraci\u00f3n de memoria, la desactivaci\u00f3n del modo de regeneraci\u00f3n diferida y el uso de procesadores con controladores que soportan el modo MAC (Maximum Activate Count) para DDR4 (1, 2 y 3 generaci\u00f3n AMD EPYC \u2018Naple\u2019, \u2018Rome\u2019 y \u2018Milan\u2019) y RFM (Refresh Management) para DDR5 (4 generaci\u00f3n AMD EPYC).
\n
Fuente: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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