{"id":77492,"date":"2020-04-10T19:42:45","date_gmt":"2020-04-10T17:42:45","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe"},"modified":"2020-04-10T19:42:45","modified_gmt":"2020-04-10T17:42:45","slug":"poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","status":"publish","type":"post","link":"https:\/\/prohoster.info\/es\/blog\/news\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","title":{"rendered":"\u00bfCuidado, ARM? Nuevos n\u00facleos de 64 bits de Synopsys ARC triplicar\u00e1n el rendimiento.","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Pocos saben que la arquitectura de procesador ARC es una de las arquitecturas m\u00e1s comunes junto con ARM, MIPS y x86. Desarrollada en la d\u00e9cada de 1980, la arquitectura ARC se aplica en diversos microcontroladores para una amplia gama de productos de alta tecnolog\u00eda, y cada a\u00f1o se producen alrededor de 1,5 mil millones<\/a><\/noindex> de dispositivos.<\/p>\n

Recientemente, Synopsys anunci\u00f3 una nueva generaci\u00f3n de n\u00facleos de 32 y 64 bits ARC, que prometen triplicar el rendimiento en comparaci\u00f3n con sus predecesores, adem\u00e1s de permitir la construcci\u00f3n de sistemas en chip con 12 n\u00facleos. De este modo, los nuevos n\u00facleos permitir\u00e1n a Synopsys competir con ARM en varias \u00e1reas nuevas.<\/p>\n

«Las aplicaciones integradas, como los controladores para unidades de estado s\u00f3lido o equipamento de red, se est\u00e1n volviendo cada vez m\u00e1s complejas, lo que requiere un aumento significativo en el rendimiento con un consumo de energ\u00eda y tama\u00f1o limitados», dijo John Koeter, vicepresidente s\u00e9nior de marketing y estrategia de propiedad intelectual en Synopsys. «Con el lanzamiento de la nueva arquitectura ARCv3 y los n\u00facleos ARC HS5x y HS6x, los desarrolladores podr\u00e1n satisfacer las crecientes demandas de rendimiento de sus SoC hoy y en el futuro».<\/p>\n

\"\u00bfCuidado,
\n<\/center><\/p>\n

Las nuevas familias de procesadores Synopsys DesignWare ARC incluyen n\u00facleos de 32 bits HS56\/HS57D\/HS58<\/a><\/noindex> y n\u00facleos de 64 bits HS66\/HS68<\/a><\/noindex>. Los reci\u00e9n anunciados procesadores est\u00e1n destinados a una amplia gama de aplicaciones, como controladores para unidades de estado s\u00f3lido (SSD), controladores de red, pilotos autom\u00e1ticos para veh\u00edculos, sistemas de infoentretenimiento para autom\u00f3viles y muchos m\u00e1s. Teniendo en cuenta las crecientes demandas de capacidad de memoria, los ARC HD6x de 64 bits permitir\u00e1n crear sistemas con 4.5 PB de DRAM, mientras que los dispositivos basados en ARC HD5x tendr\u00e1n que conformarse con capacidades menores. Sin embargo, las capacidades reales de memoria soportadas estar\u00e1n m\u00e1s influenciadas por el sistema operativo utilizado, y las ventajas visibles de los CPU de 64 bits ser\u00e1n un pipeline m\u00e1s amplio y un mayor archivo de registros.<\/p>\n

En cuanto a las arquitecturas DesignWare ARC HS5x y DesignWare ARC HS6x, admiten el conjunto de instrucciones ARCv3, que se puede ampliar con las instrucciones APEX (ARC Processor EXtensions), si alg\u00fan cliente necesita algo espec\u00edfico. Adem\u00e1s, el ARC HS57D est\u00e1 equipado con un procesador de se\u00f1ales digitales ARCv3DSP que soporta 150 instrucciones. Los nuevos n\u00facleos tienen una profundidad de canalizaci\u00f3n de 10 etapas, pueden ejecutar dos instrucciones por ciclo y est\u00e1n equipados con un m\u00f3dulo de operaciones de punto flotante de 128 bits. Al mismo tiempo, las versiones m\u00e1s avanzadas de los n\u00facleos admiten cach\u00e9s de segundo nivel (L2) de hasta 16 MB.<\/p>\n

\"\u00bfCuidado,<\/p>\n

En t\u00e9rminos de rendimiento, Synopsys declara 3 DMIPS por MHz en c\u00e1lculos enteros, as\u00ed como 5.1 CoreMark por MHz, lo cual es bastante bueno para n\u00facleos miniaturizados con un consumo de energ\u00eda m\u00ednimo. As\u00ed, 3 DMIPS por MHz  — es superior al de procesadores bastante potentes Cortex-A55<\/a><\/noindex>, mientras que 5.1 CoreMark por MHz — es m\u00e1s alto que el de cualquier otro procesador ARM para microcontroladores.<\/a><\/noindex><\/p>\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n
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Los n\u00facleos de procesador Synopsys DesignWare ARC HS5x y HS6x
<\/strong><\/p>\n<\/td>\n<\/tr>\n

<\/td>\nHS5x<\/td>\nHS6x<\/td>\n<\/tr>\n
<\/td>\nHS56<\/td>\nHS57D<\/td>\nHS58<\/td>\nHS66<\/td>\nHS68<\/td>\n<\/tr>\n
Conjunto de instrucciones<\/td>\nARCv3<\/td>\n<\/tr>\n
Instrucciones APEX<\/td>\nSoportadas<\/td>\n<\/tr>\n
Profundidad de bits<\/td>\nde 32 bits<\/td>\nde 64 bits<\/td>\n<\/tr>\n
Instrucciones por ciclo<\/td>\n2<\/td>\n<\/tr>\n
Longitud de la canalizaci\u00f3n<\/td>\n10 etapas<\/td>\n<\/tr>\n
DSP<\/td>\n\u2014<\/td>\nARCv3DSP
150 instrucciones<\/td>\n		\u2014<\/td>\n\u2014<\/td>\n\u2014<\/td>\n<\/tr>\n
Precisi\u00f3n FPU<\/td>\nFP16, FP32, FP64<\/td>\n<\/tr>\n
Cl\u00faster de procesador<\/td>\n12 n\u00facleos<\/td>\n<\/tr>\n
Aceleradores por cl\u00faster<\/td>\n16 aceleradores<\/td>\n<\/tr>\n
L1<\/td>\nCach\u00e9 de instrucciones + cach\u00e9 de datos<\/td>\n<\/tr>\n
L2<\/td>\n\u2014<\/td>\n\u2014<\/td>\n16 MB<\/td>\n\u2014<\/td>\n16 MB<\/td>\n<\/tr>\n
M\u00e1ximo volumen de memoria<\/td>\n64 GB (depende del SO)<\/td>\n4,5 Petabytes<\/td>\n<\/tr>\n
Frecuencia (en t\/p 16FFC)<\/td>\n1,8 GHz<\/td>\n<\/tr>\n
DMIPS<\/td>\n5400 DMIPS por n\u00facleo \/ 3 DMIPS por MHz<\/td>\n<\/tr>\n
CoreMark<\/td>\n9180 CoreMark por n\u00facleo \/ 5,1 CoreMark por MHz<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n

Una de las caracter\u00edsticas clave de la nueva familia DesignWare ARC HS5x y DesignWare ARC HS6x es la capacidad de crear sistemas en chip (system-on-chip, SoC) con 12 n\u00facleos de procesador de prop\u00f3sito general y 16 aceleradores especializados. Cada n\u00facleo\/acelerador en dicho procesador opera a su propia frecuencia de reloj y utiliza su propio subsistema de energ\u00eda para maximizar la eficiencia energ\u00e9tica. Junto con los nuevos n\u00facleos, Synopsys tambi\u00e9n ofrece una conexi\u00f3n coherente de cach\u00e9 intra-procesador con una velocidad de transferencia de datos de 800 GB\/s. <\/p>\n

Este tipo de SoC basado en la arquitectura ARC no es muy com\u00fan hoy en d\u00eda, pero teniendo en cuenta los prometedores procesadores para sistemas de conducci\u00f3n aut\u00f3noma, almacenamiento de datos, gesti\u00f3n de flujos de datos, la multicore y diferentes tipos de aceleradores ser\u00e1n muy \u00fatiles. Esto permitir\u00e1 a Synopsys competir con los n\u00facleos ARM por un lugar en SoC para estas aplicaciones, algo que no hab\u00eda sucedido hasta ahora. As\u00ed, los n\u00facleos DesignWare ARC HS5x y DesignWare ARC HS6x ya han atra\u00eddo el inter\u00e9s del fabricante de unidades de estado s\u00f3lido Starblaze. <\/p>\n

«Los desarrolladores de soluciones integradas de alto rendimiento se enfrentan constantemente a nuevos desaf\u00edos en la b\u00fasqueda de un alto rendimiento mientras utilizan grandes cantidades de memoria y limitaciones en el consumo de energ\u00eda y tama\u00f1o», dijo Bruce Cheng, cient\u00edfico jefe de Starblaze. «Las capacidades de los nuevos procesadores ARC HS5x de 32 bits y HS6x de 64 bits de Synopsys en t\u00e9rminos de multin\u00facleo nos permitir\u00e1n alcanzar un nuevo nivel de eficiencia energ\u00e9tica que no es ofrecido por otros procesadores disponibles en el mercado actualmente».<\/p>\n

\"\u00bfCuidado,<\/p>\n

Synopsys comenzar\u00e1 a ofrecer los n\u00facleos ARC HS56, HS57D, HS58, HS66, HS68, as\u00ed como sus versiones multiprocesador HS56MP, HS57DMP, HS58MP, HS66MP, HS68MP, comenzando en el tercer trimestre de 2020. Adem\u00e1s, la compa\u00f1\u00eda ofrecer\u00e1 el paquete ARC MetaWare Development Toolkit para la creaci\u00f3n de chips basados en estos n\u00facleos, as\u00ed como un simulador y verificador para validar el funcionamiento de SoC antes de la implementaci\u00f3n en silicio. En cuanto al soporte de sistemas operativos, los nuevos n\u00facleos ser\u00e1n compatibles con varias distribuciones de Linux, Zephyr, as\u00ed como con diferentes sistemas operativos propietarios.<\/p>\n

<\/p>\n

<\/center><\/p>\n

\t\t\t\t


\n\t\t\t\t\t\t\t\t<\/center>
Fuente: 3dnews.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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