Daniel Vetter, ing\u00e9nieur chez Intel et l'un des collaborateurs du syst\u00e8me DRM, a publi\u00e9 sur la liste de diffusion des d\u00e9veloppeurs du noyau Linux un plan pour la promotion des correctifs du pilote Xe, destin\u00e9 \u00e0 \u00eatre utilis\u00e9 avec les GPU bas\u00e9s sur l'architecture Intel Xe, qui est utilis\u00e9e dans les cartes graphiques de la famille Arc et dans la graphique int\u00e9gr\u00e9e, \u00e0 partir des processeurs Tiger Lake. Le pilote Xe est positionn\u00e9 comme la base pour assurer le support des nouvelles puces, sans lien avec le code de support des anciennes plateformes. Au cours de l'ann\u00e9e 2023, il est pr\u00e9vu de pr\u00e9parer les correctifs pour les tests des passionn\u00e9s et, si possible, d'obtenir une r\u00e9vision de d\u00e9veloppeurs non li\u00e9s \u00e0 Intel. Dans un sc\u00e9nario optimiste, le pilote sera int\u00e9gr\u00e9 dans la base principale du noyau d'ici la fin de l'ann\u00e9e. <\/p>\n
Actuellement, l\u2019int\u00e9gration dans la base principale du noyau est entrav\u00e9e par le fait que le code a \u00e9t\u00e9 initialement d\u00e9velopp\u00e9 \u00e0 huis clos dans une branche distincte du noyau, et un travail suppl\u00e9mentaire est d\u00e9sormais n\u00e9cessaire pour l'int\u00e9grer \u00e0 la base de code actuelle. Compte tenu de l\u2019exp\u00e9rience r\u00e9cente n\u00e9gative li\u00e9e au retard dans l\u2019int\u00e9gration des changements significatifs pour le pilote AMD, qui a entra\u00een\u00e9 la n\u00e9cessit\u00e9 de r\u00e9\u00e9crire certaines parties du code, il est propos\u00e9 d\u2019atteindre un consensus pr\u00e9alable sur la mise en \u0153uvre du planificateur et l'interaction avec d'autres pilotes, afin de faciliter la promotion de la base de code du pilote Xe dans le noyau principal. <\/p>\n
Le pilote Xe est construit en utilisant une nouvelle architecture, qui exploite plus activement les composants existants du syst\u00e8me DRM (Direct Rendering Manager), ainsi que les composants standards du pilote i915, non li\u00e9s \u00e0 des GPU sp\u00e9cifiques, par exemple, le code pour interagir avec les \u00e9crans, le mod\u00e8le de m\u00e9moire et l\u2019impl\u00e9mentation de execbuf. Dans les pilotes Xe et i915, il est pr\u00e9vu d'assurer le partage du code commun afin d'\u00e9viter la duplication des composants standards. Dans Mesa, le fonctionnement d'OpenGL et de Vulkan au-dessus du pilote Xe est r\u00e9alis\u00e9 au niveau des modifications apport\u00e9es aux pilotes Mesa existants Iris et ANV. \u0414\u044d\u043d\u0438\u0435\u043b \u0412\u0435\u0442\u0442\u0435\u0440 (Daniel Vetter), \u0438\u043d\u0436\u0435\u043d\u0435\u0440 \u0438\u0437 \u043a\u043e\u043c\u043f\u0430\u043d\u0438\u0438 Intel \u0438 \u043e\u0434\u0438\u043d \u0438\u0437 \u0441\u043e\u043f\u0440\u043e\u0432\u043e\u0436\u0434\u0430\u044e\u0449\u0438\u0445 \u043f\u043e\u0434\u0441\u0438\u0441\u0442\u0435\u043c\u0443 DRM, \u043e\u043f\u0443\u0431\u043b\u0438\u043a\u043e\u0432\u0430\u043b \u0432 \u0441\u043f\u0438\u0441\u043a\u0435 \u0440\u0430\u0441\u0441\u044b\u043b\u043a\u0438 \u0440\u0430\u0437\u0440\u0430\u0431\u043e\u0442\u0447\u0438\u043a\u043e\u0432 \u044f\u0434\u0440\u0430 Linux \u043f\u043b\u0430\u043d \u043f\u0440\u043e\u0434\u0432\u0438\u0436\u0435\u043d\u0438\u044f \u043f\u0430\u0442\u0447\u0435\u0439 \u0441 \u0440\u0435\u0430\u043b\u0438\u0437\u0430\u0446\u0438\u0435\u0439 \u0434\u0440\u0430\u0439\u0432\u0435\u0440\u0430 Xe, \u043f\u0440\u0435\u0434\u043d\u0430\u0437\u043d\u0430\u0447\u0435\u043d\u043d\u043e\u0433\u043e \u0434\u043b\u044f \u0438\u0441\u043f\u043e\u043b\u044c\u0437\u043e\u0432\u0430\u043d\u0438\u044f \u0441 GPU \u043d\u0430 \u0431\u0430\u0437\u0435 \u0430\u0440\u0445\u0438\u0442\u0435\u043a\u0442\u0443\u0440\u044b Intel Xe, \u043a\u043e\u0442\u043e\u0440\u0430\u044f \u0438\u0441\u043f\u043e\u043b\u044c\u0437\u0443\u0435\u0442\u0441\u044f \u0432 \u0432\u0438\u0434\u0435\u043e\u043a\u0430\u0440\u0442\u0430\u0445 \u0441\u0435\u043c\u0435\u0439\u0441\u0442\u0432\u0430 Arc \u0438 \u0438\u043d\u0442\u0435\u0433\u0440\u0438\u0440\u043e\u0432\u0430\u043d\u043d\u043e\u0439 \u0433\u0440\u0430\u0444\u0438\u043a\u0435, \u043d\u0430\u0447\u0438\u043d\u0430\u044f \u0441 \u043f\u0440\u043e\u0446\u0435\u0441\u0441\u043e\u0440\u043e\u0432 Tiger Lake. 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