{"id":111945,"date":"2023-12-03T15:10:13","date_gmt":"2023-12-03T13:10:13","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/vypusk-coreboot-4-22"},"modified":"2023-12-03T15:10:13","modified_gmt":"2023-12-03T13:10:13","slug":"vypusk-coreboot-4-22","status":"publish","type":"post","link":"https:\/\/prohoster.info\/fr\/blog\/news\/vypusk-coreboot-4-22","title":{"rendered":"Sortie de Coreboot 4.22","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"<p>La version 4.22 du projet CoreBoot est disponible, dans le cadre duquel une alternative libre aux firmwares et BIOS propri\u00e9taires est d\u00e9velopp\u00e9e. Le code du projet est distribu\u00e9 sous la licence GPLv2. 135 d\u00e9veloppeurs ont particip\u00e9 \u00e0 la cr\u00e9ation de cette nouvelle version, pr\u00e9parant 977 modifications. Il est not\u00e9 qu'\u00e0 partir de la prochaine version, le projet passera \u00e0 un nouveau sch\u00e9ma de nommage des versions, utilisant une r\u00e9f\u00e9rence \u00e0 la date (ann\u00e9e.mois.mise \u00e0 jour), par exemple, en f\u00e9vrier 2024, au lieu de la version 4.23, la version 24.02.00 sera cr\u00e9\u00e9e.      <\/p>\n<p>Principales modifications :   <\/p>\n<ul>\n<li class=\"l\"> Une premi\u00e8re r\u00e9alisation de la plateforme AMD openSIL (Open-Source Silicon Initialization Library) a \u00e9t\u00e9 ajout\u00e9e, d\u00e9veloppant des composants pour simplifier la cr\u00e9ation de firmwares.\n<li class=\"l\"> Le support de 17 cartes m\u00e8res a \u00e9t\u00e9 ajout\u00e9. 11 des cartes ajout\u00e9es sont utilis\u00e9es sur des appareils fonctionnant sous Chrome OS ou sur <a class=\"wpil_keyword_link\" href=\"https:\/\/prohoster.info\/fr\/server\/dts-gdansk\/\"   title=\"serveurs\" data-wpil-keyword-link=\"linked\"  data-wpil-monitor-id=\"4549\">serveurs<\/a> Google. Les cartes non associ\u00e9es \u00e0 Google :\n<ul>\n<li class=\"l\"> AMD Onyx\n<li class=\"l\"> Intel Meteorlake-P RVP\n<li class=\"l\"> Purism Librem 11\n<li class=\"l\"> Purism Librem L1UM v2\n<li class=\"l\"> Siemens FA EHL\n<li class=\"l\"> Supermicro X11SSW-F  <\/ul>\n<li class=\"l\"> Le support pour SoC AMD Genoa a \u00e9t\u00e9 ajout\u00e9.\n<li class=\"l\"> Sur l'architecture x86, une prise en charge de la section <data> a \u00e9t\u00e9 mise en \u0153uvre \u00e0 des \u00e9tapes avant l'initialisation de la m\u00e9moire, permettant d'utiliser des d\u00e9finitions de variables globales dans le code C. Au stade du bloc de d\u00e9marrage, les donn\u00e9es sont attach\u00e9es imm\u00e9diatement apr\u00e8s le code et sont ensuite plac\u00e9es dans le cache, en utilisant le concept de Cache-As-RAM (VMA).\n<li class=\"l\"> Pour les syst\u00e8mes x86, au stade ramstage et aux stades avant l'initialisation de la m\u00e9moire, le support du cache pour le syst\u00e8me de fichiers CBFS, utilis\u00e9 pour le placement des composants Coreboot sur Flash, a \u00e9t\u00e9 r\u00e9alis\u00e9. Le cache CBFS permet de d\u00e9compresser les fichiers CBFS, en utilisant la fonction cbfs_map() sans r\u00e9server une zone m\u00e9moire distincte pour le fichier. Les param\u00e8tres PRERAM_CBFS_CACHE_SIZE et RAMSTAGE_CBFS_CACHE_SIZE sont propos\u00e9s pour configurer la taille du cache.\n<li class=\"l\"> La possibilit\u00e9 d'incorporer romstage dans le bloc de d\u00e9marrage (bootblock) a \u00e9t\u00e9 ajout\u00e9e. La fourniture de romstage en tant que partie du bloc de d\u00e9marrage permet de r\u00e9duire la taille du code de 10 \u00e0 20 000 lignes. Des situations o\u00f9 une fourniture distincte de romstage peut \u00eatre n\u00e9cessaire comprennent les configurations avec vboot ou le mode de secours, ainsi que les appareils avec une taille de bloc de d\u00e9marrage limit\u00e9e (Intel APL 32K) ou un support de d\u00e9marrage trop lent (certains SoC ARM).\n<li class=\"l\"> Dans gfx, une API a \u00e9t\u00e9 ajout\u00e9e pour d\u00e9tecter la pr\u00e9sence d'un \u00e9cran externe sur les appareils avec des puces Intel.\n<li class=\"l\"> Dans pci_rom, la capacit\u00e9 d'ajouter un checksum pour VBIOS lors du remplissage de la table VFCT a \u00e9t\u00e9 mise en \u0153uvre. Un tel checksum est v\u00e9rifi\u00e9 par certains pilotes AMD pour Windows.\n<li class=\"l\"> Des modifications ont \u00e9t\u00e9 apport\u00e9es pour permettre l'ex\u00e9cution de Windows sur certains appareils Chromebook avec Coreboot.\n<li class=\"l\"> G\u00e9n\u00e9ration de la table ACPI pour les appareils bas\u00e9s sur l'architecture ARM64 mise en \u0153uvre.\n<li class=\"l\"> Compatibilit\u00e9 am\u00e9lior\u00e9e avec les sp\u00e9cifications ACPI.\n<li class=\"l\"> Les param\u00e8tres MRC (Memory Reference Code) pour les cartes SNB+MRC ont \u00e9t\u00e9 transf\u00e9r\u00e9s dans la structure DeviceTree.\n<li class=\"l\"> Les composants payload bas\u00e9s sur U-Boot et edk2 ont \u00e9t\u00e9 mis \u00e0 jour.\n<li class=\"l\"> Les outils utilis\u00e9s ont \u00e9t\u00e9 mis \u00e0 jour : GMP 6.3.0, binutils 2.41 et MPFR 4.2.1.\n<li class=\"l\"> La branche principale dans le d\u00e9p\u00f4t Git a \u00e9t\u00e9 renomm\u00e9e de  en <main>.  <\/ul>\n<p>Source : <a content=\"nofollow\" rel=\"nofollow\" href=\"https:\/\/www.opennet.ru\/opennews\/art.shtml?num=60224\">opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"<p>\u0414\u043e\u0441\u0442\u0443\u043f\u0435\u043d \u0440\u0435\u043b\u0438\u0437 \u043f\u0440\u043e\u0435\u043a\u0442\u0430 CoreBoot 4.22, \u0432 \u0440\u0430\u043c\u043a\u0430\u0445 \u043a\u043e\u0442\u043e\u0440\u043e\u0433\u043e \u0440\u0430\u0437\u0440\u0430\u0431\u0430\u0442\u044b\u0432\u0430\u0435\u0442\u0441\u044f \u0441\u0432\u043e\u0431\u043e\u0434\u043d\u0430\u044f \u0430\u043b\u044c\u0442\u0435\u0440\u043d\u0430\u0442\u0438\u0432\u0430 \u043f\u0440\u043e\u043f\u0440\u0438\u0435\u0442\u0430\u0440\u043d\u044b\u043c \u043f\u0440\u043e\u0448\u0438\u0432\u043a\u0430\u043c \u0438 BIOS. \u041a\u043e\u0434 \u043f\u0440\u043e\u0435\u043a\u0442\u0430 \u0440\u0430\u0441\u043f\u0440\u043e\u0441\u0442\u0440\u0430\u043d\u044f\u0435\u0442\u0441\u044f \u043f\u043e\u0434 \u043b\u0438\u0446\u0435\u043d\u0437\u0438\u0435\u0439 GPLv2. \u0412 \u0441\u043e\u0437\u0434\u0430\u043d\u0438\u0438 \u043d\u043e\u0432\u043e\u0439 \u0432\u0435\u0440\u0441\u0438\u0438 \u043f\u0440\u0438\u043d\u044f\u043b\u043e \u0443\u0447\u0430\u0441\u0442\u0438\u0435 135 \u0440\u0430\u0437\u0440\u0430\u0431\u043e\u0442\u0447\u0438\u043a\u043e\u0432, \u043a\u043e\u0442\u043e\u0440\u044b\u0435 \u043f\u043e\u0434\u0433\u043e\u0442\u043e\u0432\u0438\u043b\u0438 977 \u0438\u0437\u043c\u0435\u043d\u0435\u043d\u0438\u0439. \u041e\u0442\u043c\u0435\u0447\u0430\u0435\u0442\u0441\u044f, \u0447\u0442\u043e \u043d\u0430\u0447\u0438\u043d\u0430\u044f \u0441\u043e \u0441\u043b\u0435\u0434\u0443\u044e\u0449\u0435\u0433\u043e \u0432\u044b\u043f\u0443\u0441\u043a\u0430 \u043f\u0440\u043e\u0435\u043a\u0442 \u043f\u0435\u0440\u0435\u0439\u0434\u0451\u0442 \u043d\u0430 \u043d\u043e\u0432\u0443\u044e \u0441\u0445\u0435\u043c\u0443 \u043d\u0430\u0438\u043c\u0435\u043d\u043e\u0432\u0430\u043d\u0438\u044f \u0432\u0435\u0440\u0441\u0438\u0439, \u0438\u0441\u043f\u043e\u043b\u044c\u0437\u0443\u044e\u0449\u0443\u044e \u043f\u0440\u0438\u0432\u044f\u0437\u043a\u0443 \u043a \u0434\u0430\u0442\u0435 (\u0433\u043e\u0434.\u043c\u0435\u0441\u044f\u0446.\u043e\u0431\u043d\u043e\u0432\u043b\u0435\u043d\u0438\u0435), \u043d\u0430\u043f\u0440\u0438\u043c\u0435\u0440, \u0432 \u0444\u0435\u0432\u0440\u0430\u043b\u0435 2024 [&hellip;]<\/p>\n","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"author":1,"featured_media":0,"comment_status":"open","ping_status":"open","sticky":false,"template":"","format":"standard","meta":{"footnotes":""},"categories":[702],"tags":[],"class_list":["post-111945","post","type-post","status-publish","format-standard","hentry","category-news"],"aioseo_notices":[],"aioseo_head":"\n\t\t<!-- All in One SEO 5.0.2 - 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