{"id":114581,"date":"2024-03-26T12:25:42","date_gmt":"2024-03-26T10:25:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen"},"modified":"2024-03-26T12:25:42","modified_gmt":"2024-03-26T10:25:43","slug":"zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","status":"publish","type":"post","link":"https:\/\/prohoster.info\/fr\/blog\/news\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","title":{"rendered":"ZenHammer \u2014 m\u00e9thode d'attaque visant \u00e0 alt\u00e9rer le contenu de la m\u00e9moire sur les plateformes AMD Zen","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Des chercheurs de l'\u00c9cole polytechnique f\u00e9d\u00e9rale de Zurich ont d\u00e9velopp\u00e9 une m\u00e9thode d'attaque appel\u00e9e ZenHammer, qui est une variante des attaques de type RowHammer visant \u00e0 modifier le contenu de bits individuels dans la m\u00e9moire dynamique (DRAM), adapt\u00e9e pour \u00eatre utilis\u00e9e sur des plateformes avec des processeurs AMD. Les m\u00e9thodes pr\u00e9c\u00e9dentes d'attaques de type RowHammer \u00e9taient limit\u00e9es aux syst\u00e8mes bas\u00e9s sur des processeurs Intel, mais l'\u00e9tude a montr\u00e9 que des distorsions des cellules de m\u00e9moire pouvaient \u00e9galement \u00eatre obtenues sur des plateformes avec des contr\u00f4leurs de m\u00e9moire d'AMD. <\/p>\n

Le fonctionnement de la m\u00e9thode a \u00e9t\u00e9 d\u00e9montr\u00e9 sur des syst\u00e8mes AMD Zen 2 et Zen 3 avec de la m\u00e9moire DDR4 de trois grands fabricants (Samsung, Micron et SK Hynix). L'attaque permet de contourner le m\u00e9canisme TRR (Target Row Refresh) impl\u00e9ment\u00e9 dans les puces m\u00e9moire, destin\u00e9 \u00e0 prot\u00e9ger contre la distorsion des cellules de m\u00e9moire dans des lignes voisines. Les chercheurs estiment que les syst\u00e8mes bas\u00e9s sur le CPU AMD Zen 3 sont plus vuln\u00e9rables que ceux avec des processeurs Intel Coffee Lake, et qu'ils sont plus faciles et efficaces \u00e0 attaquer. Sur les syst\u00e8mes AMD Zen 2, des distorsions de cellules ont \u00e9t\u00e9 obtenues pour 7 des 10 puces DDR4 test\u00e9es, tandis que pour les syst\u00e8mes Zen 3, c'\u00e9tait pour 6 des 10. Les chercheurs ont \u00e9galement analys\u00e9 la possibilit\u00e9 d'attaquer des syst\u00e8mes AMD Zen 4 avec de la m\u00e9moire DDR5, mais la m\u00e9thode d\u00e9velopp\u00e9e pour DDR4 n'a pu \u00eatre reproduite avec succ\u00e8s que sur 1 des 10 puces m\u00e9moire DDR5 test\u00e9es ; cela n'exclut pas la possibilit\u00e9 d'attaque, mais n\u00e9cessite le d\u00e9veloppement de mod\u00e8les de lecture plus efficaces, adapt\u00e9s aux dispositifs DDR5. <\/p>\n

Pour les puces AMD, il a \u00e9t\u00e9 possible d'adapter des exploits pr\u00e9c\u00e9demment d\u00e9velopp\u00e9s, modifiant le contenu des enregistrements dans la table des pages de la m\u00e9moire (PTE, page table entry) pour obtenir des privil\u00e8ges noyau, contournant la v\u00e9rification du mot de passe\/des autorisations par la modification de la m\u00e9moire du processus sudo et alt\u00e9rant la cl\u00e9 RSA-2048 stock\u00e9e en m\u00e9moire dans OpenSSH pour reconstituer la cl\u00e9 priv\u00e9e. L'attaque sur les pages m\u00e9moire a pu \u00eatre reproduite sur 7 des 10 puces DDR4 test\u00e9es, l'attaque sur la cl\u00e9 RSA - sur 6 puces, et l'attaque sur sudo - sur 4 puces, avec un temps d'attaque de 164, 267 et 209 secondes, respectivement.

\"ZenHammer<\/center> <\/p>\n

Cette m\u00e9thode pourrait \u00e9galement \u00eatre applicable pour attaquer un syst\u00e8me via des navigateurs, pour apporter des modifications \u00e0 partir de machines virtuelles<\/a> ou pour organiser une attaque par r\u00e9seau. Sur GitHub, sous licence MIT, le code source de l'outil DARE pour le reverse engineering de la disposition des adresses dans la m\u00e9moire DRAM est disponible, ainsi que deux ensembles d'utilitaires pour le fuzzing-test des distorsions de bits en m\u00e9moire - ddr4_zen2_zen3_pub pour les puces DDR4 (Zen 2 et Zen 3) et ddr5_zen4_pub pour les puces DDR5 (Zen 4), qui peuvent \u00eatre utilis\u00e9s pour v\u00e9rifier la vuln\u00e9rabilit\u00e9 de leurs syst\u00e8mes \u00e0 cette attaque.

\"ZenHammer<\/center> <\/p>\n

La m\u00e9thode de d\u00e9formation des bits utilise le RowHammer, qui repose sur le fait que dans la m\u00e9moire DRAM, qui consiste en un tableau bidimensionnel de cellules, comprenant un condensateur et un transistor, une lecture continue d'une m\u00eame zone de m\u00e9moire entra\u00eene des fluctuations de tension et des anomalies, provoquant une petite perte de charge des cellules voisines. Si l'intensit\u00e9 de la lecture est \u00e9lev\u00e9e, une cellule adjacente peut perdre une quantit\u00e9 suffisante de charge, et le cycle de r\u00e9g\u00e9n\u00e9ration suivant ne parvient pas \u00e0 restaurer son \u00e9tat initial, ce qui entra\u00eene une modification de la valeur des donn\u00e9es enregistr\u00e9es dans la cellule. Au cours de l'\u00e9tude, des caract\u00e9ristiques des m\u00e9canismes de mappage de la m\u00e9moire physique et de synchronisation avec la mise \u00e0 jour de la m\u00e9moire utilis\u00e9s dans les processeurs AMD ont \u00e9t\u00e9 identifi\u00e9es, permettant de recr\u00e9er l'adressage bas niveau DRAM, de d\u00e9terminer les adresses des cellules voisines, de d\u00e9velopper des m\u00e9thodes de contournement du cache, et de calculer les mod\u00e8les et la fr\u00e9quence des op\u00e9rations entra\u00eenant une perte de charge. <\/p>\n

Pour se prot\u00e9ger contre le RowHammer, les fabricants de puces appliquent le m\u00e9canisme TRR (Target Row Refresh), qui bloque la d\u00e9formation des cellules dans certains cas, mais ne prot\u00e8ge pas contre toutes les variantes possibles d'attaque. La m\u00e9thode de protection la plus efficace reste l'utilisation de la m\u00e9moire avec des codes de correction d'erreurs (ECC), qui compliquent consid\u00e9rablement, mais n'excluent pas compl\u00e8tement la r\u00e9alisation d'attaques de type RowHammer. Une augmentation de la fr\u00e9quence de r\u00e9g\u00e9n\u00e9ration de la m\u00e9moire permet \u00e9galement de r\u00e9duire la probabilit\u00e9 de succ\u00e8s d'une attaque. <\/p>\n

La soci\u00e9t\u00e9 AMD a publi\u00e9 un rapport sur le probl\u00e8me, dans lequel il est indiqu\u00e9 que les processeurs AMD utilisent des contr\u00f4leurs de m\u00e9moire conformes aux sp\u00e9cifications DDR, et \u00e9tant donn\u00e9 que le succ\u00e8s de l'attaque d\u00e9pend principalement des param\u00e8tres du syst\u00e8me et de la m\u00e9moire DRAM, les questions concernant la r\u00e9solution du probl\u00e8me doivent \u00eatre adress\u00e9es aux fabricants de m\u00e9moire et de syst\u00e8mes. Parmi les m\u00e9thodes existantes pour compliquer la r\u00e9alisation d'attaques de type Rowhammer, on mentionne l'utilisation de m\u00e9moire ECC, l'augmentation de la fr\u00e9quence de r\u00e9g\u00e9n\u00e9ration de la m\u00e9moire, la d\u00e9sactivation du mode de r\u00e9g\u00e9n\u00e9ration diff\u00e9r\u00e9e et l'utilisation de processeurs avec des contr\u00f4leurs prenant en charge le mode MAC (Maximum Activate Count) pour DDR4 (1, 2 et 3 g\u00e9n\u00e9rations AMD EPYC \u00abNaple\u00bb, \u00abRome\u00bb et \u00abMilan\u00bb) et RFM (Refresh Management) pour DDR5 (4e g\u00e9n\u00e9ration AMD EPYC).
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Source : opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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