{"id":77492,"date":"2020-04-10T19:42:45","date_gmt":"2020-04-10T17:42:45","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe"},"modified":"2020-04-10T19:42:45","modified_gmt":"2020-04-10T17:42:45","slug":"poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","status":"publish","type":"post","link":"https:\/\/prohoster.info\/fr\/blog\/news\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","title":{"rendered":"Attention, ARM ? Les nouveaux c\u0153urs 64 bits de Synopsys ARC vont tripler les performances","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

Peu de gens savent que l'architecture processeur ARC est l'une des plus r\u00e9pandues, aux c\u00f4t\u00e9s de l'ARM, du MIPS et du x86. D\u00e9velopp\u00e9e dans les ann\u00e9es 1980, l'architecture ARC est utilis\u00e9e dans divers microcontr\u00f4leurs pour une large gamme de produits technologiques, avec environ 1,5 milliard<\/a><\/noindex> d'appareils.<\/p>\n

R\u00e9cemment, la soci\u00e9t\u00e9 Synopsys a annonc\u00e9 une nouvelle g\u00e9n\u00e9ration de c\u0153urs de processeurs 32 et 64 bits ARC, qui promettent de tripler la performance par rapport \u00e0 leurs pr\u00e9d\u00e9cesseurs, tout en permettant de construire des syst\u00e8mes sur puce dot\u00e9s de 12 c\u0153urs. Ainsi, ces nouveaux c\u0153urs permettront \u00e0 Synopsys de rivaliser avec ARM dans plusieurs nouveaux secteurs.<\/p>\n

\u00abLes applications int\u00e9gr\u00e9es telles que les contr\u00f4leurs pour disques SSD ou les \u00e9quipements r\u00e9seau deviennent de plus en plus complexes, n\u00e9cessitant une augmentation significative des performances tout en maintenant une consommation d'\u00e9nergie et une taille limit\u00e9es\u00bb, a d\u00e9clar\u00e9 John Koeter, vice-pr\u00e9sident senior du marketing et de la strat\u00e9gie en propri\u00e9t\u00e9 intellectuelle chez Synopsys. \u00abAvec le lancement de la nouvelle architecture ARCv3 et des c\u0153urs ARC HS5x et HS6x, les d\u00e9veloppeurs pourront r\u00e9pondre \u00e0 la demande croissante en performance de leurs SoC aujourd'hui et \u00e0 l'avenir\u00bb.<\/p>\n

\"Attention,
\n<\/center><\/p>\n

Les nouvelles gammes de processeurs Synopsys DesignWare ARC comprennent des c\u0153urs 32 bits HS56\/HS57D\/HS58<\/a><\/noindex> et des c\u0153urs 64 bits HS66\/HS68<\/a><\/noindex>. Les processeurs r\u00e9cemment annonc\u00e9s sont destin\u00e9s \u00e0 un large \u00e9ventail d'applications, telles que les contr\u00f4leurs pour disques SSD, les contr\u00f4leurs r\u00e9seau, les syst\u00e8mes de conduite autonome pour v\u00e9hicules, les syst\u00e8mes d'infodivertissement pour automobiles et bien d'autres. Compte tenu des exigences croissantes en mati\u00e8re de m\u00e9moire vive, les ARC HD6x 64 bits permettront de cr\u00e9er des syst\u00e8mes avec 4,5 Po de DRAM, tandis que les dispositifs bas\u00e9s sur ARC HD5x devront se limiter \u00e0 des volumes inf\u00e9rieurs. Cependant, les volumes r\u00e9els de m\u00e9moire vive support\u00e9s seront plut\u00f4t dict\u00e9s par le syst\u00e8me d'exploitation utilis\u00e9, et les avantages visibles des CPU 64 bits seront un pipeline plus large et un fichier de registres plus important.<\/p>\n

En ce qui concerne les architectures DesignWare ARC HS5x et DesignWare ARC HS6x, elles prennent en charge l'ensemble d'instructions ARCv3, qui peut \u00eatre \u00e9tendu avec les instructions APEX (ARC Processor EXtensions), si l'un des clients a besoin de quelque chose de sp\u00e9cifique. De plus, l'ARC HS57D est \u00e9quip\u00e9 d'un processeur de signal num\u00e9rique ARCv3DSP prenant en charge 150 instructions. Les nouveaux c\u0153urs ont une profondeur de pipeline de 10 \u00e9tapes, peuvent ex\u00e9cuter deux instructions par cycle, et sont \u00e9galement \u00e9quip\u00e9s d'un module de calcul \u00e0 virgule flottante de 128 bits. Ainsi, les versions les plus avanc\u00e9es des c\u0153urs prennent en charge un cache de deuxi\u00e8me niveau (L2) allant jusqu'\u00e0 16 Mo.<\/p>\n

\"Attention,<\/p>\n

En termes de performance, Synopsys affirme atteindre 3 DMIPS par MHz pour les calculs entiers, et 5,1 CoreMark par MHz, ce qui est tr\u00e8s respectable pour de petits c\u0153urs \u00e0 tr\u00e8s faible consommation d'\u00e9nergie. Ainsi, 3 DMIPS par MHz est sup\u00e9rieur \u00e0 celui de nombreux processeurs puissants Cortex-A55<\/a><\/noindex>, tandis que 5,1 CoreMark par MHz est sup\u00e9rieur \u00e0 celui de n'importe quel autre. processeur ARM pour microcontr\u00f4leurs.<\/a><\/noindex><\/p>\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n\n
\n

Les c\u0153urs de processeur Synopsys DesignWare ARC HS5x et HS6x
<\/strong><\/p>\n<\/td>\n<\/tr>\n

<\/td>\nHS5x<\/td>\nHS6x<\/td>\n<\/tr>\n
<\/td>\nHS56<\/td>\nHS57D<\/td>\nHS58<\/td>\nHS66<\/td>\nHS68<\/td>\n<\/tr>\n
Ensemble d'instructions<\/td>\nARCv3<\/td>\n<\/tr>\n
Instructions APEX<\/td>\nPrise en charge<\/td>\n<\/tr>\n
Largeur<\/td>\n32 bits<\/td>\n64 bits<\/td>\n<\/tr>\n
Instructions par cycle<\/td>\n2<\/td>\n<\/tr>\n
Longueur du pipeline<\/td>\n10 \u00e9tapes<\/td>\n<\/tr>\n
DSP<\/td>\n\u2014<\/td>\nARCv3DSP
150 instructions<\/td>\n		\u2014<\/td>\n\u2014<\/td>\n\u2014<\/td>\n<\/tr>\n
Pr\u00e9cision FPU<\/td>\nFP16, FP32, FP64<\/td>\n<\/tr>\n
Cluster de processeurs<\/td>\n12 c\u0153urs<\/td>\n<\/tr>\n
Acc\u00e9l\u00e9rateurs par cluster<\/td>\n16 acc\u00e9l\u00e9rateurs<\/td>\n<\/tr>\n
L1<\/td>\nCache d'instructions + Cache de donn\u00e9es<\/td>\n<\/tr>\n
L2<\/td>\n\u2014<\/td>\n\u2014<\/td>\n16 Mo<\/td>\n\u2014<\/td>\n16 Mo<\/td>\n<\/tr>\n
M\u00e9moire maximale<\/td>\n64 Go (selon le syst\u00e8me d'exploitation)<\/td>\n4,5 Petaoctets<\/td>\n<\/tr>\n
Fr\u00e9quence (sur le t\/p 16FFC)<\/td>\n1,8 GHz<\/td>\n<\/tr>\n
DMIPS<\/td>\n5400 DMIPS par c\u0153ur \/ 3 DMIPS par MHz<\/td>\n<\/tr>\n
CoreMark<\/td>\n9180 CoreMark par c\u0153ur \/ 5,1 CoreMark par MHz<\/td>\n<\/tr>\n<\/tbody>\n<\/table>\n

L'une des caract\u00e9ristiques cl\u00e9s de la nouvelle famille DesignWare ARC HS5x et DesignWare ARC HS6x est la possibilit\u00e9 de cr\u00e9er des syst\u00e8mes sur puce (SoC) avec 12 c\u0153urs de processeur \u00e0 usage g\u00e9n\u00e9ral et 16 acc\u00e9l\u00e9rateurs sp\u00e9cialis\u00e9s. Chaque c\u0153ur\/acc\u00e9l\u00e9rateur dans un tel processeur fonctionne \u00e0 sa propre fr\u00e9quence d'horloge et utilise son propre sous-syst\u00e8me d'alimentation pour maximiser l'efficacit\u00e9 \u00e9nerg\u00e9tique. Avec ces nouveaux c\u0153urs, Synopsys propose \u00e9galement une connexion de coh\u00e9rence de cache intrac\u0153ur avec un d\u00e9bit de donn\u00e9es de 800 Go\/s. <\/p>\n

Des SoC bas\u00e9s sur l'architecture ARC ne sont pas tr\u00e8s courants aujourd'hui, mais compte tenu des processeurs prometteurs pour les syst\u00e8mes de pilotage automatique, le stockage de donn\u00e9es, la gestion des flux de donn\u00e9es, la multicoeur et diff\u00e9rents types d'acc\u00e9l\u00e9rateurs, ils seront tr\u00e8s utiles. Cela permettra \u00e0 Synopsys de concurrencer les c\u0153urs ARM pour une place dans les SoC pour ces applications, ce qui n'a pas \u00e9t\u00e9 le cas jusqu'\u00e0 pr\u00e9sent. Ainsi, les c\u0153urs DesignWare ARC HS5x et DesignWare ARC HS6x ont d\u00e9j\u00e0 suscit\u00e9 l'int\u00e9r\u00eat du fabricant de disques \u00e0 \u00e9tat solide Starblaze. <\/p>\n

\u00abLes d\u00e9veloppeurs de solutions embarqu\u00e9es hautes performances sont constamment confront\u00e9s \u00e0 de nouveaux d\u00e9fis en mati\u00e8re d'atteinte de hautes performances tout en utilisant de grandes quantit\u00e9s de m\u00e9moire et en faisant face \u00e0 des contraintes de consommation d'\u00e9nergie et de dimension\u00bb, a d\u00e9clar\u00e9 Bruce Cheng, responsable scientifique chez Starblaze. \u00abLes capacit\u00e9s des nouveaux processeurs 32 bits ARC HS5x et 64 bits HS6x de Synopsys en mati\u00e8re de multic\u0153ur nous permettront d'atteindre un nouveau niveau d'efficacit\u00e9 \u00e9nerg\u00e9tique qui n'est pas offert par d'autres processeurs actuellement pr\u00e9sents sur le march\u00e9\u00bb.<\/p>\n

\"Attention,<\/p>\n

Synopsys commencera \u00e0 proposer les c\u0153urs ARC HS56, HS57D, HS58, HS66, HS68, ainsi que leurs versions multiprocesseur HS56MP, HS57DMP, HS58MP, HS66MP, HS68MP, \u00e0 partir du troisi\u00e8me trimestre 2020. De plus, la soci\u00e9t\u00e9 proposera le package ARC MetaWare Development Toolkit pour la cr\u00e9ation de circuits int\u00e9gr\u00e9s bas\u00e9s sur ces c\u0153urs, ainsi qu'un simulateur et un v\u00e9rificateur pour tester la fonctionnalit\u00e9 des SoC avant leur fabrication en silicium. En ce qui concerne le support des syst\u00e8mes d'exploitation, ces nouveaux c\u0153urs seront compatibles avec plusieurs distributions Linux, Zephyr, ainsi que divers syst\u00e8mes d'exploitation propri\u00e9taires.<\/p>\n

<\/p>\n

<\/center><\/p>\n

\t\t\t\t


\n\t\t\t\t\t\t\t\t<\/center>
Source : 3dnews.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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Les nouveaux c\u0153urs 64 bits de Synopsys ARC tripleront les performances | ProHoster","description":"Peu de gens savent que l'architecture de processeur ARC est l'une des architectures les plus r\u00e9pandues aux c\u00f4t\u00e9s d'ARM, MIPS et x86.","canonical_url":"https:\/\/prohoster.info\/fr\/blog\/news\/poberegis-arm-novye-64-razryadnye-yadra-synopsys-arc-uvelichat-proizvoditelnost-vtroe","robots":"max-image-preview:large","keywords":"","webmasterTools":{"miscellaneous":""},"schema":null,"og:locale":"fr_FR","og:site_name":"ProHoster | \u041a\u0443\u043f\u0438\u0442\u044c \u043d\u0430\u0434\u0435\u0436\u043d\u044b\u0439 \u0445\u043e\u0441\u0442\u0438\u043d\u0433 \u0434\u043b\u044f \u0441\u0430\u0439\u0442\u043e\u0432 \u0441 \u0437\u0430\u0449\u0438\u0442\u043e\u0439 \u043e\u0442 DDoS, VPS VDS \u0441\u0435\u0440\u0432\u0435\u0440\u044b","og:type":"article","og:title":"\ud83e\udd47\u041f\u043e\u0431\u0435\u0440\u0435\u0433\u0438\u0441\u044c, ARM? \u041d\u043e\u0432\u044b\u0435 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