{"id":114581,"date":"2024-03-26T12:25:42","date_gmt":"2024-03-26T10:25:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen"},"modified":"2024-03-26T12:25:42","modified_gmt":"2024-03-26T10:25:43","slug":"zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","status":"publish","type":"post","link":"https:\/\/prohoster.info\/it\/blog\/news\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","title":{"rendered":"ZenHammer \u2014 un metodo di attacco per alterare il contenuto della memoria su piattaforme AMD Zen","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

I ricercatori dell'Istituto Federale Svizzero di Tecnologia di Zurigo hanno sviluppato il metodo di attacco ZenHammer, una variante degli attacchi di tipo RowHammer per modificare il contenuto di singoli bit nella memoria dinamica ad accesso casuale (DRAM), adattata per l'uso su piattaforme con processori AMD. I metodi di attacco precedenti di tipo RowHammer erano limitati a sistemi basati su processori Intel, ma la ricerca condotta ha dimostrato che \u00e8 possibile ottenere distorsioni nelle celle di memoria anche su piattaforme con controller di memoria della AMD. <\/p>\n

Il funzionamento del metodo \u00e8 stato dimostrato su sistemi AMD Zen 2 e Zen 3 con memoria DDR4 di tre dei principali produttori (Samsung, Micron e SK Hynix). L'attacco consente di bypassare con successo il meccanismo TRR (Target Row Refresh) implementato nei chip di memoria, mirato a proteggere contro la distorsione delle celle di memoria nelle righe adiacenti. Secondo le stime dei ricercatori, i sistemi basati su CPU AMD Zen 3 sono pi\u00f9 vulnerabili rispetto ai sistemi con processori Intel Coffee Lake e sono pi\u00f9 facili ed efficaci da attaccare. Nei sistemi AMD Zen 2, le distorsioni delle celle sono state ottenute su 7 dei 10 chip DDR4 testati, mentre nei sistemi Zen 3 su 6 dei 10. I ricercatori hanno anche analizzato la possibilit\u00e0 di attacchi sui sistemi AMD Zen 4 con memoria DDR5, ma il metodo sviluppato per DDR4 \u00e8 stato riprodotto con successo solo su 1 dei 10 chip di memoria DDR5 testati, sebbene la possibilit\u00e0 di attacco non sia esclusa, ma richiede lo sviluppo di modelli di lettura pi\u00f9 efficaci, adatti per dispositivi DDR5. <\/p>\n

Per lavorare con i chip AMD, \u00e8 stato possibile adattare exploit precedentemente sviluppati che modificano il contenuto delle voci nella tabella delle pagine di memoria (PTE, page table entry) per ottenere privilegi di kernel, bypassando la verifica della password e delle autorizzazioni attraverso la modifica della memoria del processo sudo, e danneggiando la chiave pubblica RSA-2048 memorizzata in memoria in OpenSSH per ricreare la chiave privata. L'attacco alle pagine di memoria \u00e8 stato riprodotto su 7 dei 10 chip DDR4 testati, l'attacco alla chiave RSA su 6 chip, e l'attacco a sudo su 4 chip, con un tempo di attacco di 164, 267 e 209 secondi, rispettivamente.

\"ZenHammer<\/center> <\/p>\n

Il metodo pu\u00f2 essere applicato anche per attaccare un sistema tramite browser, per apportare modifiche da macchine virtuali<\/a> o per organizzare un attacco di rete. Su GitHub, con licenza MIT, \u00e8 disponibile il codice sorgente dello strumento DARE per il reverse engineering della disposizione degli indirizzi nella memoria DRAM, insieme a due set di utility per il fuzzing dei test di distorsione dei bit in memoria \u2014 ddr4_zen2_zen3_pub per chip DDR4 (Zen 2 e Zen 3) e ddr5_zen4_pub per chip DDR5 (Zen 4), che possono essere utilizzati per testare i propri sistemi contro questa vulnerabilit\u00e0.

\"ZenHammer<\/center> <\/p>\n

Per la distorsione dei bit viene utilizzato il metodo RowHammer, che si basa sul fatto che in memoria DRAM, che \u00e8 un array bidimensionale di celle composte da un condensatore e un transistor, l'esecuzione di continui accessi alla stessa area di memoria provoca fluttuazioni di tensione e anomalie che portano a una leggera perdita di carica nelle celle adiacenti. Se l'intensit\u00e0 di lettura \u00e8 alta, una cella adiacente pu\u00f2 perdere una quantit\u00e0 significativa di carica e il ciclo di rigenerazione successivo potrebbe non riuscire a ripristinare il suo stato originale, portando a una modifica del valore dei dati memorizzati nella cella. Durante la ricerca, sono state identificate le peculiarit\u00e0 dei meccanismi di mapping della memoria fisica e di sincronizzazione con l'aggiornamento della memoria utilizzati nei processori AMD, che hanno consentito di ricreare un'addrizzazione a basso livello della DRAM, identificare gli indirizzi delle celle adiacenti, sviluppare metodi di bypass della cache, calcolare modelli e frequenze di operazioni che portano alla perdita di carica. <\/p>\n

Per proteggersi dal RowHammer, i produttori di chip utilizzano il meccanismo TRR (Target Row Refresh), che blocca la distorsione delle celle in casi specifici, ma non protegge da tutte le possibili varianti di attacco. Il metodo di protezione pi\u00f9 efficace rimane l'uso di memoria con codici di correzione degli errori (ECC), che complicano notevolmente, ma non escludono del tutto, la possibilit\u00e0 di attacchi di tipo RowHammer. Aumentare la frequenza di rigenerazione della memoria pu\u00f2 anche ridurre la probabilit\u00e0 di un attacco riuscito. <\/p>\n

L'azienda AMD ha pubblicato un rapporto sul problema, in cui si afferma che nei processori AMD sono utilizzati controller di memoria conformi alle specifiche DDR, e poich\u00e9 il successo dell'attacco dipende principalmente dalle impostazioni di sistema e dalla memoria DRAM, per la risoluzione del problema \u00e8 necessario contattare i produttori di memoria e i sistemi. Tra i metodi esistenti per complicare l'esecuzione di attacchi nella classe Rowhammer si menzionano l'uso di memoria ECC, l'aumento della frequenza di rigenerazione della memoria, la disattivazione della modalit\u00e0 di rigenerazione ritardata e l'uso di processori con controller che supportano la modalit\u00e0 MAC (Maximum Activate Count) per DDR4 (1\u00b0, 2\u00b0 e 3\u00b0 generazione AMD EPYC 'Naple', 'Rome' e 'Milan') e RFM (Refresh Management) per DDR5 (4\u00b0 generazione AMD EPYC).
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Fonte: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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