{"id":114581,"date":"2024-03-26T12:25:42","date_gmt":"2024-03-26T10:25:43","guid":{"rendered":"https:\/\/prohoster.info\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen"},"modified":"2024-03-26T12:25:42","modified_gmt":"2024-03-26T10:25:43","slug":"zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","status":"publish","type":"post","link":"https:\/\/prohoster.info\/it\/blog\/novosti-interneta\/zenhammer-metod-ataki-dlya-iskazheniya-soderzhimogo-pamyati-na-platformah-amd-zen","title":{"rendered":"ZenHammer - un metodo di attacco per alterare il contenuto della memoria sulle piattaforme AMD Zen","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

I ricercatori dell'ETH di Zurigo hanno sviluppato un metodo di attacco chiamato ZenHammer, che rappresenta una variante degli attacchi di tipo RowHammer per modificare il contenuto di singoli bit nella memoria ad accesso casuale dinamica (DRAM), adattato per l'uso su piattaforme con processori AMD. I metodi di attacco RowHammer precedenti erano limitati ai sistemi basati su processori Intel, ma la ricerca condotta ha dimostrato che le distorsioni delle celle di memoria possono essere ottenute anche su piattaforme con controller di memoria di AMD. <\/p>\n

Il funzionamento del metodo \u00e8 stato dimostrato su sistemi AMD Zen 2 e Zen 3 con memoria DDR4 di tre importanti produttori (Samsung, Micron e SK Hynix). L'attacco riesce a eludere il meccanismo TRR (Target Row Refresh) implementato nei chip di memoria, progettato per proteggere contro la distorsione delle celle di memoria in righe adiacenti. Secondo gli studiosi, i sistemi con CPU AMD Zen 3 sono pi\u00f9 vulnerabili rispetto ai sistemi con processori Intel Coffee Lake, risultando pi\u00f9 facili ed efficaci da attaccare. Nei sistemi AMD Zen 2, \u00e8 riuscita a produrre distorsioni delle celle per 7 su 10 chip DDR4 testati, mentre nei sistemi Zen 3 per 6 su 10. Gli studiosi hanno anche analizzato la possibilit\u00e0 di attacco su sistemi AMD Zen 4 con memoria DDR5, ma il metodo sviluppato per DDR4 \u00e8 stato riprodotto con successo solo su 1 su 10 chip di memoria DDR5 testati; la possibilit\u00e0 di attacco non \u00e8 esclusa, ma richiede lo sviluppo di schemi di lettura pi\u00f9 efficaci, adatti per i dispositivi DDR5. <\/p>\n

Per il lavoro con i chip AMD, \u00e8 stato possibile adattare exploit precedentemente sviluppati che modificano il contenuto delle voci nella tabella delle pagine di memoria (PTE, page table entry) per ottenere privilegi di kernel, eludendo il controllo della password\/autenticazione tramite la modifica della memoria del processo sudo e danneggiando la chiave pubblica RSA-2048 memorizzata in OpenSSH per ricreare la chiave privata. L'attacco alle pagine di memoria \u00e8 stato riprodotto su 7 dei 10 chip DDR4 testati, l'attacco alla chiave RSA su 6 chip, e l'attacco a sudo su 4 chip, con un tempo di attacco di 164, 267 e 209 secondi, rispettivamente.

\"ZenHammer<\/center> <\/p>\n

Il metodo pu\u00f2 essere applicato anche per attaccare il sistema tramite i browser, per apportare modifiche da di macchine virtuali<\/a> o per organizzare un attacco tramite rete. Su GitHub \u00e8 disponibile, sotto licenza MIT, il codice sorgente dello strumento DARE per il reverse engineering della disposizione degli indirizzi nella memoria DRAM, cos\u00ec come due set di utilit\u00e0 per il fuzzing che testano la distorsione dei bit in memoria \u2014 ddr4_zen2_zen3_pub per chip DDR4 (Zen 2 e Zen 3) e ddr5_zen4_pub per chip DDR5 (Zen 4), che possono essere utilizzati per verificare la vulnerabilit\u00e0 dei propri sistemi all'attacco.

\"ZenHammer<\/center> <\/p>\n

Per la distorsione dei bit viene utilizzato il metodo RowHammer, che si basa sul fatto che nella memoria DRAM, che rappresenta una matrice bidimensionale di celle costituite da un condensatore e da un transistor, l'esecuzione continua di letture nella stessa area di memoria porta a fluttuazioni di tensione e anomalie che causano una piccola perdita di carica nelle celle vicine. Se l'intensit\u00e0 della lettura \u00e8 elevata, la cella vicina pu\u00f2 perdere una quantit\u00e0 significativa di carica e il successivo ciclo di rigenerazione non riesce a ripristinare il suo stato originale, il che comporta una modifica del valore dei dati memorizzati nella cella. Durante la ricerca, sono state identificate le caratteristiche dei meccanismi di mapping della memoria fisica e di sincronizzazione con l'aggiornamento della memoria utilizzati nei processori AMD, che hanno permesso di ricreare un'indirizzamento a basso livello della DRAM, di determinare gli indirizzi delle celle vicine, di sviluppare metodi per aggirare la memorizzazione nella cache e di calcolare i modelli e la frequenza delle operazioni che portano alla perdita di carica. <\/p>\n

Per proteggere dai RowHammer, i produttori di chip utilizzano il meccanismo TRR (Target Row Refresh), che blocca la distorsione delle celle in situazioni specifiche, ma non offre protezione contro tutte le possibili varianti di attacco. Il metodo pi\u00f9 efficace di protezione rimane l'uso della memoria con codici di correzione degli errori (ECC), che complicano notevolmente, ma non eliminano completamente la possibilit\u00e0 di attacchi di tipo RowHammer. Aumentare la frequenza di rigenerazione della memoria pu\u00f2 anche ridurre la probabilit\u00e0 di un attacco riuscito. <\/p>\n

L'azienda AMD ha pubblicato un rapporto sul problema, affermando che nei processori AMD vengono utilizzati controller di memoria conformi alle specifiche DDR. Poich\u00e9 il successo dell'attacco dipende principalmente dalle impostazioni del sistema e dalla memoria DRAM, i produttori di memoria e sistemi dovrebbero essere contattati per domande sulla risoluzione del problema. Tra i metodi esistenti per complicare l'esecuzione di attacchi di tipo Rowhammer si menzionano l'uso di memoria ECC, l'aumento della frequenza di rigenerazione della memoria, la disattivazione della modalit\u00e0 di rigenerazione ritardata e l'utilizzo di processori con controller che supportano la modalit\u00e0 MAC (Maximum Activate Count) per DDR4 (1\u00b0, 2\u00b0 e 3\u00b0 generazione AMD EPYC \u00abNaple\u00bb, \u00abRome\u00bb e \u00abMilan\u00bb) e RFM (Refresh Management) per DDR5 (4\u00b0 generazione AMD EPYC).
\n
Fonte: opennet.ru<\/a> <\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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