{"id":34705,"date":"2019-10-31T21:59:54","date_gmt":"2019-10-31T18:59:54","guid":{"rendered":"https:\/\/prohoster.info\/blog\/arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77\/"},"modified":"2019-10-31T21:59:54","modified_gmt":"2019-10-31T18:59:54","slug":"arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77","status":"publish","type":"post","link":"https:\/\/prohoster.info\/it\/blog\/news\/arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77","title":{"rendered":"ARM ha presentato un nuovo potente core CPU \u2014 Cortex-A77","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

ARM ha presentato il suo ultimo design del processore - Cortex-A77. Come il Cortex-A76 dello scorso anno, questo core \u00e8 destinato a compiti di alta gamma negli smartphone e in una vasta gamma di dispositivi. Il progettista mira ad aumentare il numero di istruzioni eseguite per ciclo (IPC). Le frequenze di clock e il consumo energetico sono rimasti circa sui livelli del Cortex-A76.<\/p>\n

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Attualmente, ARM \u00e8 focalizzata sull'aumento rapido delle prestazioni dei suoi core. Secondo i suoi piani, a partire dal Cortex-A73 del 2016 fino al design Hercules del 2020, l'azienda intende aumentare di 2,5 volte la potenza della CPU. I passaggi da 16 nm a 10 nm e successivamente a 7 nm hanno gi\u00e0 consentito di aumentare la frequenza di clock e, in combinazione con l'architettura Cortex-A75 e successivamente il Cortex-A76, secondo le stime di ARM, si \u00e8 raggiunto fino a un aumento delle prestazioni di 1,8 volte. Ora il core Cortex-A77 consentir\u00e0, grazie all'aumento dell'IPC, di incrementare ulteriormente le prestazioni del 20 % mantenendo la stessa frequenza di clock. Quindi, un aumento di 2,5 volte entro il 2020 diventa del tutto realistico.<\/p>\n

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Nonostante l'aumento dell'IPC del 20 %, secondo le stime di ARM, il consumo energetico del A77 non \u00e8 aumentato. Il compromesso in questo caso \u00e8 che la superficie del chip A77 \u00e8 circa il 17 % pi\u00f9 grande rispetto all'A76 a parit\u00e0 di norme tecnologiche. Di conseguenza, il costo di un singolo core aumenter\u00e0 leggermente. Se si confronta il raggiungimento di ARM con i leader del settore, vale la pena dire che AMD con Zen 2 ha ottenuto un aumento dell'IPC del 15 % rispetto a Zen+, mentre il valore dell'IPC dei core Intel rimane da anni pi\u00f9 o meno stabile.<\/p>\n

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La finestra di esecuzione con modifica dell'ordine delle istruzioni (out-of-order window size) \u00e8 stata aumentata del 25 %, arrivando a 160 unit\u00e0, consentendo al core di aumentare il parallelismo dei calcoli. Anche nel Cortex-A76 c'era un grande buffer degli indirizzi delle diramazioni (Branch Target Buffer), mentre nel Cortex-A77 \u00e8 stato ulteriormente aumentato del 33 %, fino a 8 KB, permettendo al blocco di predizione delle diramazioni di gestire in modo efficace l'aumento del numero di istruzioni parallele.<\/p>\n

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Un'ulteriore novit\u00e0 interessante \u00e8 rappresentata da una nuova cache da 1,5 KB, in cui vengono memorizzate le macrooperazioni (MOP) restituiti dal modulo di decodifica. L'architettura del processore ARM decodifica le istruzioni dall'applicazione utente in macrooperazioni pi\u00f9 piccole, che vengono poi suddivise in microoperazioni trasmesse gi\u00e0 al core di esecuzione. La cache MOP \u00e8 utilizzata per ridurre l'impatto dei salti e dei reset mancati, poich\u00e9 ora le macrooperazioni vengono memorizzate in un blocco separato e non richiedono nuova decodifica, aumentando cos\u00ec la larghezza di banda complessiva del core. In alcuni carichi di lavoro, il nuovo blocco si rivela un'aggiunta estremamente utile alla cache istruzioni standard.<\/p>\n

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Nel core di esecuzione \u00e8 stato aggiunto un quarto blocco ALU e un secondo blocco di ramificazioni. Il quarto ALU aumenta la larghezza di banda complessiva del processore di 1,5 volte grazie alla possibilit\u00e0 di eseguire istruzioni a singolo ciclo (come ADD e SUB) e operazioni intere a doppio ciclo come la moltiplicazione. Gli altri due ALU possono elaborare solo istruzioni di base a singolo ciclo, mentre l'ultimo blocco si occupa di operazioni matematiche pi\u00f9 complesse, come la divisione, la moltiplicazione con accumulo, ecc. Il secondo blocco di ramificazioni all'interno del core di esecuzione raddoppia il numero di transizioni di ramificazione simultanee con cui il core pu\u00f2 lavorare, cosa utile nei casi in cui due delle sei istruzioni inviate riguardano transizioni di ramificazione. I test interni in ARM hanno mostrato un incremento delle prestazioni dovuto all'uso di questo secondo blocco di transizioni.<\/p>\n

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Tra le altre modifiche al core, si segnala l'aggiunta di un secondo pipeline per la crittografia AES, l'aumento della larghezza di banda della memoria, un meccanismo di prefetching dei dati di nuova generazione migliorato, che consente di aumentare l'efficienza energetica e al contempo incrementare la larghezza di banda del sistema DRAM, ottimizzazione delle prestazioni della cache e cos\u00ec via.<\/p>\n

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Il maggiore incremento si osserva nel Cortex-A77 per le operazioni intere e i calcoli in virgola mobile. Questo \u00e8 confermato dai test interni di ARM in SPEC, che hanno mostrato un aumento delle prestazioni del 20 % e del 35 % rispettivamente per le operazioni intere e i calcoli in virgola mobile. I miglioramenti della larghezza di banda della memoria si attestano tra il 15 e il 20 %. In generale, le ottimizzazioni e le modifiche nell'A77 consentono un aumento medio delle prestazioni del 20 % rispetto alla generazione precedente. Grazie a tecnologie pi\u00f9 recenti come il 7 nm ULV, possiamo ottenere ulteriori vantaggi nei chip finali.<\/p>\n

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ARM ha progettato il Cortex-A77 per funzionare in accoppiamento 4+4 big.LITTLE (4 core potenti e 4 core semplici ad alta efficienza energetica). Tuttavia, data l'aumentata area della nuova architettura, molti produttori possono presentare accoppiamenti 1+3+4 o 2+2+4 per risparmiare costi, gi\u00e0 ampiamente praticati, dove solo uno o due core saranno dei veri e propri A77 non ridotti.<\/p>\n

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Fonte: 3dnews.ru<\/a><\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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