Samsung memanfaatkan sepenuhnya kelebihan perintisnya dalam litografi semikonduktor menggunakan pengimbas EUV. Memandangkan TSMC bersedia untuk mula menggunakan pengimbas 13,5 nm pada bulan Jun, menyesuaikannya untuk menghasilkan cip dalam generasi kedua proses 7 nm, Samsung menyelam lebih dalam dan
Membantu syarikat bergerak dengan pantas daripada menawarkan teknologi proses 7nm dengan EUV kepada menghasilkan penyelesaian 5nm juga dengan EUV adalah hakikat bahawa Samsung mengekalkan kesalingoperasian antara elemen reka bentuk (IP), alatan reka bentuk dan alat pemeriksaan. Antara lain, ini bermakna bahawa pelanggan syarikat akan menjimatkan wang untuk membeli alat reka bentuk, ujian dan blok IP siap sedia. PDK untuk reka bentuk, metodologi (DM, metodologi reka bentuk) dan platform reka bentuk automatik EDA telah tersedia sebagai sebahagian daripada pembangunan cip untuk piawaian 7-nm Samsung dengan EUV pada suku keempat tahun lepas. Semua alatan ini akan memastikan pembangunan projek digital juga untuk teknologi proses 5 nm dengan transistor FinFET.
Berbanding dengan proses 7nm menggunakan pengimbas EUV, yang syarikat itu
Samsung menghasilkan produk menggunakan pengimbas EUV di kilang S3 di Hwaseong. Pada separuh kedua tahun ini, syarikat itu akan menyiapkan pembinaan kemudahan baharu di sebelah Fab S3, yang akan bersedia untuk menghasilkan cip menggunakan proses EUV tahun depan.
Sumber: 3dnews.ru