{"id":34705,"date":"2019-10-31T21:59:54","date_gmt":"2019-10-31T18:59:54","guid":{"rendered":"https:\/\/prohoster.info\/blog\/arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77\/"},"modified":"2019-10-31T21:59:54","modified_gmt":"2019-10-31T18:59:54","slug":"arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77","status":"publish","type":"post","link":"https:\/\/prohoster.info\/pt\/blog\/news\/arm-predstavila-novoe-moshhnoe-yadro-tsp-cortex-a77","title":{"rendered":"A ARM apresentou um novo e poderoso n\u00facleo de CPU \u2014 Cortex-A77","gt_translate_keys":[{"key":"rendered","format":"text"}]},"content":{"rendered":"

A ARM apresentou seu mais recente design de processador \u2014 Cortex-A77. Assim como o Cortex-A76 do ano passado, este n\u00facleo \u00e9 destinado a tarefas de alto desempenho em smartphones e uma variedade de dispositivos. O foco do desenvolvedor \u00e9 aumentar o n\u00famero de comandos executados por ciclo (IPC). As frequ\u00eancias de clock e o consumo de energia permaneceram aproximadamente no mesmo n\u00edvel do Cortex-A76.<\/p>\n

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Atualmente, a ARM est\u00e1 focada em aumentar rapidamente o desempenho de seus n\u00facleos. De acordo com seus planos, a partir do Cortex-A73 de 2016 at\u00e9 o design Hercules de 2020, a empresa pretende aumentar a pot\u00eancia da CPU em 2,5 vezes. As transi\u00e7\u00f5es de 16 nm para 10 nm e, em seguida, para 7 nm j\u00e1 permitiram elevar a frequ\u00eancia de clock, e combinadas com a arquitetura Cortex-A75 e depois Cortex-A76, estima-se que a ARM atingiu at\u00e9 agora um aumento de 1,8 vezes no desempenho. Agora, o n\u00facleo Cortex-A77 permitir\u00e1 um aumento de desempenho adicional de 20% na mesma frequ\u00eancia de clock devido ao crescimento do IPC. Portanto, um aumento de 2,5 vezes em 2020 se torna bastante realiz\u00e1vel.<\/p>\n

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Apesar do aumento de 20% no IPC, estima-se que o consumo de energia do A77 n\u00e3o aumentou. O compromisso aqui \u00e9 que a \u00e1rea do chip A77 \u00e9 cerca de 17% maior que a do A76 nas mesmas normas tecnol\u00f3gicas. Como resultado, o custo de cada n\u00facleo aumentar\u00e1 um pouco. Se compararmos o feito da ARM com os l\u00edderes do setor, \u00e9 importante mencionar que a AMD no Zen 2 alcan\u00e7ou um aumento de IPC de 15% em rela\u00e7\u00e3o ao Zen+, enquanto o valor de IPC dos n\u00facleos da Intel permanece aproximadamente no mesmo n\u00edvel h\u00e1 anos.<\/p>\n

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A janela de execu\u00e7\u00e3o com reordena\u00e7\u00e3o de comandos (tamanho da janela out-of-order) foi aumentada em 25%, para 160 unidades, permitindo que o n\u00facleo aumente o paralelismo dos c\u00e1lculos. Mesmo no Cortex-A76 j\u00e1 havia um grande buffer de endere\u00e7os de ramifica\u00e7\u00e3o (Branch Target Buffer), e no Cortex-A77 ele foi aumentado ainda mais em 33%, para 8 KB, permitindo que o bloco de previs\u00e3o de ramifica\u00e7\u00f5es lide de forma eficaz com o aumento no n\u00famero de instru\u00e7\u00f5es paralelas.<\/p>\n

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Outra novidade interessante \u00e9 o novo cache de 1,5 KB, onde s\u00e3o armazenadas as macroinstru\u00e7\u00f5es (MOP) retornadas do m\u00f3dulo de decodifica\u00e7\u00e3o. A arquitetura do processador ARM decodifica instru\u00e7\u00f5es do aplicativo do usu\u00e1rio em macroinstru\u00e7\u00f5es menores e, em seguida, as divide em microinstru\u00e7\u00f5es, que s\u00e3o passadas para o n\u00facleo de execu\u00e7\u00e3o. O cache MOP \u00e9 usado para reduzir o impacto de desvios perdidos e reinicializa\u00e7\u00f5es, uma vez que agora as macroinstru\u00e7\u00f5es est\u00e3o armazenadas em um bloco separado e n\u00e3o requerem reaprendizagem, aumentando assim a largura de banda geral do n\u00facleo. Em algumas cargas de trabalho, o novo bloco \u00e9 um complemento extremamente \u00fatil ao cache de instru\u00e7\u00f5es padr\u00e3o.<\/p>\n

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Foi adicionado um quarto bloco ALU e um segundo bloco de desvios no n\u00facleo de execu\u00e7\u00e3o. O quarto ALU aumenta a capacidade total do processador em 1,5 vezes, permitindo a execu\u00e7\u00e3o de instru\u00e7\u00f5es de ciclo \u00fanico (como ADD e SUB) e opera\u00e7\u00f5es inteiras de dois ciclos, como multiplica\u00e7\u00e3o. Os outros dois ALUs podem processar apenas instru\u00e7\u00f5es b\u00e1sicas de ciclo \u00fanico, enquanto o \u00faltimo bloco \u00e9 carregado com opera\u00e7\u00f5es matem\u00e1ticas mais complexas, como divis\u00e3o e multiplica\u00e7\u00e3o acumulativa. O segundo bloco de desvios dentro do n\u00facleo de execu\u00e7\u00e3o dobra o n\u00famero de desvios simult\u00e2neos que o n\u00facleo pode gerenciar, o que \u00e9 \u00fatil em situa\u00e7\u00f5es em que dois dos seis comandos enviados s\u00e3o desvios. Testes internos na ARM mostraram um ganho de desempenho com o uso desse segundo bloco de desvios.<\/p>\n

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Entre outras mudan\u00e7as no n\u00facleo, est\u00e1 a adi\u00e7\u00e3o de um segundo pipeline de criptografia AES, aumento da largura de banda da mem\u00f3ria, um mecanismo aprimorado de pr\u00e9-busca de dados de pr\u00f3xima gera\u00e7\u00e3o que melhora a efici\u00eancia do consumo de energia e, ao mesmo tempo, aumenta a largura de banda do sistema DRAM, otimiza\u00e7\u00f5es de funcionamento do cache e assim por diante.<\/p>\n

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O maior aumento \u00e9 observado no Cortex-A77 em opera\u00e7\u00f5es inteiras e c\u00e1lculos com ponto flutuante. Isso \u00e9 confirmado por testes internos da ARM no SPEC, que mostraram um aumento de desempenho de 20 % e 35 % em opera\u00e7\u00f5es inteiras e c\u00e1lculos com ponto flutuante, respectivamente. As melhorias na largura de banda da mem\u00f3ria est\u00e3o na faixa de 15 a 20 %. No geral, as otimiza\u00e7\u00f5es e mudan\u00e7as no A77 resultam em um aumento m\u00e9dio de 20% no desempenho em compara\u00e7\u00e3o com a gera\u00e7\u00e3o anterior. Gra\u00e7as a normas tecnol\u00f3gicas mais novas, como 7 nm ULV, podemos obter vantagens adicionais nos chips finais.<\/p>\n

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A ARM projetou o Cortex-A77 para trabalhar em conjunto 4+4 big.LITTLE (4 n\u00facleos poderosos e 4 n\u00facleos simples e eficientes em termos de energia). No entanto, considerando a \u00e1rea aumentada da nova arquitetura, muitos fabricantes, visando economia, podem apresentar combina\u00e7\u00f5es 1+3+4 ou 2+2+4, que j\u00e1 est\u00e3o sendo amplamente praticadas, onde apenas um ou dois n\u00facleos ser\u00e3o A77 completos e n\u00e3o reduzidos.<\/p>\n

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Fonte: 3dnews.ru<\/a><\/p>","protected":false,"gt_translate_keys":[{"key":"rendered","format":"html"}]},"excerpt":{"rendered":"

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