谷歌提供免費生產試行開放晶片的機會

谷歌與製造公司 SkyWater Technology 和 Efabless 合作推出了一項計劃,允許開放硬體開發人員免費製造他們開發的晶片。該倡議旨在刺激開放硬體的開發,降低開發開放項目的成本並簡化與製造工廠的互動。由於這項舉措,任何人都可以開始開發自己的客製化晶片,而不必擔心生產初始原型的高成本。所有生產、包裝和運輸費用均由 Google 承擔。

加入免費製作計畫的申請可以每兩個月提交一次。最近的插槽將於 8 月 30 日關閉,設法進入的晶片將於 18 月 40 日準備好,並於 40 月 50 日發送給作者。從提交的申請中篩選出5個項目(如果提交的申請少於XNUMX個,則所有通過正確性檢查的項目將投入生產)。根據生產結果,開發商將收到 XNUMX 個晶片和 XNUMX 個已安裝晶片的主機板。

僅接受在開放許可下完全分發的項目的應用程序,不受保密協議 (NDA) 的約束,也不限制其產品的使用範圍。用於生產的資料必須以 GDSII 格式傳輸,透過提供的測試集並從來源設計檔案複製(即提交開源項目,但您將無法提交用於生產的專有設計)。

為了簡化開放晶片開發,可以使用以下開源工具:

  • SkyWater PDK(製程設計套件)是一個工具包,描述了 SkyWater 工廠使用的 130nm 技術製程 (SKY130),並允許您準備微電路生產所需的設計文件。
  • OpenLane 是一組元件,用於將專用晶片 (ASIC) 的 RTL 電路設計自動轉換為晶片工廠使用的 GDSII 格式。
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  • XLS(加速硬體綜合)是一個工具包,用於綜合設計文件與晶片硬件,這些硬體對應於所提供的所需功能的高級描述,以軟體開發的風格設計。
  • Bazel 彙編系統的一組規則,支援開放式工具(Yosys、Verilator、OpenROAD),用於使用硬體描述語言(Verilog、VHDL、Chisel、nMigen)。
  • OpenROAD 是一個用於自動化開源微電路開發流程的架構。
  • Verible 是一套使用 Verilog 語言進行開發的工具,包括解析器、樣式格式化系統和 linter。

來源: opennet.ru

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